基于模块化设计方法实现FPGA动态部分重构  被引量:12

A Module-Based Dynamic Partial Reconfiguration of FPGAs

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作  者:阆盛雨[1] 孙辉先[1] 陈晓敏[1] 安军社[1] 张健[1] 

机构地区:[1]中国科学院空间科学与应用研究中心

出  处:《微计算机信息》2008年第5期164-166,共3页Control & Automation

基  金:中国科学院知识创新基金资助项目(KGCX-JG-07)

摘  要:介绍了Xilinx FPGA的配置原理和FPGA模块化设计流程以及划分重构模块的原则。通过一个实例介绍了采用模块化设计方法实现Virtex-E FPGA动态部分重构的过程,能使重构模块在系统运行时改变其逻辑功能,而固定模块逻辑功能不中断,同时器件的重构时间大大减少。The configuration principle of Xilinx FPGA is discussed. The procedure is based on the Modular Design Flow to build a dynamical and partial reconfigurable system,using Xilinx Virtex FPGA. This kind of FPGA can dynamically reconfigure parts of its own functionality without interrupting or conflicting the rest of the design. The method can greatly reduce the amount of FPGA reconfiguration time.

关 键 词:FPGA 动态部分重构 重构 VIRTEX 

分 类 号:TN791[电子电信—电路与系统]

 

参考文献:

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