低功耗33MHz采样频率,10比特流水线结构的模数转换器  被引量:6

A Low Power 33MSample/s, 10 Bit Pipeline Architecture ADC

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作  者:程闪峰[1] 张洁[1] 闵昊[1] 

机构地区:[1]复旦大学专用集成电路与系统国家重点实验室,上海200433

出  处:《复旦学报(自然科学版)》2001年第3期335-341,共7页Journal of Fudan University:Natural Science

基  金:亿恒科技公司赞助科研项目

摘  要:介绍了一个 33MHz,10bit,3 3V流水线结构的模数转换器 (ADC) .该ADC采用了一种带预放大级的运算放大器和一种动态比较器来降低功耗 ;采用了电荷泵电路来提升时钟信号的电压 ;采用了一个恒跨导偏置电路 .本芯片在 0 35 μmCMOS工艺上实现 ,芯片面积为 1 2× 0 .4mm2 .芯片工作在 33MHz时功耗为 6 9 4mW ,采样 16MHz正弦信号时的信噪比 (SNDR)为 5 8 4dB .A 33 MSample/s, 10 bit, 3.3 V pipeline ADC is presented. A dynamic comparator and a cascode opamp structure with a low gain preamplifier are used to minimize power dissipation; a charge pump is used to boost clock voltage, an improved on chip constant transconductance voltage reference is used to bias the sample/hold amplifier. This chip is implemented in 0.35 μm CMOS technology and occupies 1.2×0.4 mm 2. It consumes 69.4 mW when operating at 33 MHz. SNDR is 58.4 dB when the chip samples 16 MHz sinusoid wave.

关 键 词:模数转换器 流水线 动态比较器 预放大器 电荷泵 模数转换电路 

分 类 号:TN792[电子电信—电路与系统]

 

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