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出 处:《计算机科学》2014年第7期36-39,73,共5页Computer Science
基 金:国家自然科学基金(61202076);北京市教委科技计划面上项目(KM201210005022)资助
摘 要:如何提高多核处理器的性能和降低多核处理器中Cache的功耗已经成为下一代多核处理器的研究热点。为了降低片上多核处理器的功耗,基于路适应算法可以采用一种新的动态划分机制,该机制主要由路分配模块和动态功耗控制模块组成。路分配模块在程序运行过程中根据处理器核所运行线程的工作集的大小调整处理器核所分配的Cache路。动态功耗控制模块利用程序运行的局部性原理,将处理器核所运行线程的工作空间控制在少数Cache路中。关闭剩余的Cache路,从而达到降低Cache功耗的目的。该机制使用Simics全系统模拟平台模拟多核处理器,并用SpecOMP测试集测试了系统的性能和功耗。与传统的Cache(Conventional L2Cache,C-L2)相比,其IPC提高了9.27%,功耗降低了10.95%。Improving processor performance and reducing energy consumption of the Cache have become research topic of the next-generation processor. To reduce energy consumption in CMP, a new mechanism based on dynamical way-a- daptable Cache can be adopted. The mechanism mainly consists of way reallocate module and dynamic power control module. Way reallocate module reassigns ways between cores based on thread' s working set on the execution of the program. Our mechanism implements low power consumption by dynamic power control module. The proposed scheme based on dynamical way-adaptable Cache is implemented and simulated by Simics. We applied several programs selected from SpecOMP as benchmarks. Compared with traditional cache(Conventional L2 Cache, C-L2), its IPC increases by 9. 27%, and power consumption reduces by 10. 95 ~.
分 类 号:TP391[自动化与计算机技术—计算机应用技术]
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