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作 者:张嗣忠[1]
机构地区:[1]东南大学国家专用集成电路系统工程技术研究中心,南京210096
出 处:《东南大学学报(自然科学版)》2002年第4期572-575,共4页Journal of Southeast University:Natural Science Edition
摘 要:介绍了典型N数字小数分频器的工作过程 ,在此基础上分析了由级联累加器实现的积分功能 .其累加器溢出按Psscal三角形数值计算 .利用计算结果可实现频率合成器的相位补偿及减小相位抖动 .最后给出了 4级Psscal三角形数值计算的实现电路图及模拟结果 ,分析了该电路的一些特点 .该电路已嵌入在已设计的Σ Δ调制小数分频专用集成电路中 ,采用无锡上华 0 .6μmCMOS双铝双多晶标准单元工艺制造 。The working process of typical N Digital fractional frequency divider is introduced and the integration function performed by cascaded accumulators is analyzed. The overflow of the accumulators is calculated according to a Pascal triangle. Phrase compensation and reduction of phrase vibration of the frequency synthesizer can be accomplished using the calculation results. At last, a 4 level Pascal triangle circuit is presented and simulated, and the characteristics of the circuit is also introduced. The circuit has been embedded in the ASIC of ∑-Δ fractional frequency divider which is based on 0.6 μm micron double poly silicon and double metal CMOS technology in Wuxi CSMC HJ Co.Ltd., and it has been applied on the microwave signal generator.
关 键 词:N-数字小数分频器 累加器 相位补偿 Pascal三角形 数值计算 频率合成器 专用集成电路
分 类 号:TN742.1[电子电信—电路与系统] TN492
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