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机构地区:[1]湘潭大学物理与光电工程学院,湖南湘潭411105 [2]湘潭大学信息工程学院,湖南湘潭411105
出 处:《湘潭大学自然科学学报》2014年第4期15-19,共5页Natural Science Journal of Xiangtan University
基 金:国家自然科学基金项目(61176032)
摘 要:在平方电路的基础上设计出一种新型电流模式的乘法器,用0.18μm CMOS集成工艺对电路进行Cadence仿真测试,结果表明,设计的电路具有高频特性好、高速、高精度、低误差、低功耗等优点.在10 MHz下,非线性误差约为0.46%,总谐波失真约为0.89%,总功耗约为80.72μW.从而该乘法器可以作为一个基本模块在电路设计中得到广泛的应用.A novel current-mode analog multiplier is proposed in this paper, which is based on current square circuits. Compared with previous works, the major advantages of this multiplier are wider bandwidth, higher speed, lower power consumption and lower error. The CMOS analog multiplier is designed and simulated in 0.18μm CMOS process technology with 1.8 V power supply. Simulation results show that nonlinearity error is about 0.46I%. The total harmonic distortion is about 0.89% in 10 MHz. The quiescent power consumption is only 80.72 μW. As a result, it can be considered as a useful building block in integrated circuit.
分 类 号:TN43[电子电信—微电子学与固体电子学]
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