基于VHDL语言的数字时钟设计  

作　　者：刘颖杰 李波 吕紫薇 

机构地区：[1]河北农业大学机电工程学院

出　　处：《现代经济信息》2018年第12期434-434,共1页Modern Economic Information

摘　　要：利用VHDL硬件语言,在QUARTUSII的开发环境中设计数字时钟,采用自上而下的实现方法,实现了时(24)、分(60)、秒(60)的计时,秒计时的频率为1Hz,数码管用动态扫描实时显示计数的时、分、秒,校时时,对秒位进行清零,对分和时位以4Hz的频率递增计数,并且能够在59分钟的第51、53、57秒发出频率为512Hz的低音,在59分钟的第59秒发出1024Hz的高音。

关 键 词：VHDL语言 数字时钟设计 QUARTUSII 

分 类 号：TN095[电子电信—物理电子学]