仇玉林

作品数：60被引量：119H指数：6
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供职机构：中国科学院微电子研究所更多>>
发文主题：低功耗电路结构异步集成电路TURBO码更多>>
发文领域：电子电信自动化与计算机技术理学更多>>
发文期刊：《微电子技术》《微电子学》《半导体技术》《电子科技大学学报》更多>>
所获基金：国家自然科学基金国家高技术研究发展计划北京市属高等学校中青年骨干人才培养计划北京市委组织部优秀人才培养资助项目更多>>
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利用CMOS模拟电路设计实现的新型概率译码器
《数据采集与处理》2009年第3期369-374,共6页杨曙辉 李学华 仇玉林 
国家自然科学基金(60501007)资助项目;北京市教委科技面上项目(KM200510772007);北京市委组织部优秀人才(0042D0500705)资助项目;北京市中青年骨干教师项目
利用CMOS模拟电路设计了模拟概率计算模块,并以此为基础,通过晶体管级的模拟电路设计,构造了(5,2,3)网格码完整的新型模拟概率译码器,给出了模拟译码器的译码性能。当信噪比大于4.8dB时,对于950 kHz的输入信号,输出没有错误。当输入信号...
关键词：概率计算 网格码 模拟译码器 TURBO码 LDPC码 
具有概率分离计算功能的二级流水线电路设计
《微电子学》2009年第3期357-361,共5页杨曙辉 仇玉林 
国家高技术研究发展(863)计划基金资助项目(2007AA04Z352);国家自然科学基金资助项目(60501007);北京市教委科技项目(KM200510772007);北京市属高校人才强教计划资助项目(71A0811104)
在通信系统的接收机中,解调器的输出通常是串行的"软比特"信息。利用模拟电路设计的信道译码器需要并行的数据,以实现后验概率译码计算。为了实现串并转换以及降低模拟译码器的复杂度和功耗,利用0.6μm CMOS工艺,为模拟译码器设计了新...
关键词：二级流水线电路 概率分离计算 模拟译码器 串并转换 
一种(5,2,3)网格码CMOS电路模拟译码器
《信号处理》2009年第4期526-531,共6页杨曙辉 李学华 仇玉林 
国家自然科学基金(No.60501007);北京市教委科技面上项目(No.KM200510772007);北京市委组织部优秀人才项目(No.0042D0500705);北京市中青年骨干教师项目
基于后验概率算法,采用CMOS工艺,通过晶体管级的模拟电路设计,构造了完整的(5,2,3)网格码模拟概率译码器。详细分析了部分单元电路的工作原理,并给出了模拟译码器的译码性能。当信噪比大于4.8dB时,对于950KHz的输入信号,输出没有错误。...
关键词：后验概率算法(APP) 模拟概率译码器 网格码 TURBO码 LDPC码 
IEEE 802.16e中LDPC译码器的实现被引量：3
《微计算机信息》2008年第29期18-19,11,共3页李刚 黑勇 仇玉林 
国家自然科学基金资助项目(60576026);项目名称:RFCMOS无线接收机新结构研究
面向IEEE802.16e中LDPC码,分析了各种译码算法的译码性能,归一化最小和(NMS)算法具备较高译码性能和实现复杂度低的特点。提出一种基于部分并行方式的LDPC译码器结构,可以满足IEEE802.16e中非规则LDPC码的译码要求。在FPGA上实现了该译...
关键词：WIMAX IEEE 802.16e LDPC译码器 部分并行 FPGA 
一种准循环LDPC解码器的设计与实现被引量：6
《微电子学与计算机》2008年第7期52-55,共4页李刚 黑勇 仇玉林 
国家自然科学基金项目(60576026)
面向准循环LDPC码的硬件实现,定点分析了各种解码算法的解码性能,偏移量最小和(OMS)算法具备较高解码性能和实现复杂度低的特点.提出一种基于部分并行方式的准循环LDPC解码器结构,在FPGA上利用该结构成功实现了WiMAX标准中的LDPC解码器....
关键词：准循环LDPC码 LDPC解码器 WIMAX FPGA 
基于MOS管亚阈值特性的模拟译码器
《微电子学》2008年第3期415-419,共5页杨曙辉 仇玉林 
国家自然科学基金资助项目(60501007);北京市教委科技项目(KM20051772007);北京市委组织部优秀人才项目(0042D0500705);北京市中青年骨干教师项目(07660013)
利用MOS管亚阈值特性,构造了输入输出均为电流信号的模拟乘法器;经过变形,设计了模拟概率计算电路。以此为基础,通过晶体管级的模拟电路设计,构造了新型的网格码模拟译码器,给出了模拟译码器的译码性能。模拟结果表明,在速度一定的条件...
关键词：亚阈值 模拟译码器 网格码 概率译码 TURBO码 
MB-OFDM UWB系统中高吞吐率Viterbi译码器的实现被引量：2
《微电子学与计算机》2008年第4期18-21,共4页李刚 黑勇 仇玉林 
提出了一种用于MB-OFDM UWB系统的高吞吐率低功耗Viterbi译码器结构.该结构利用基4蝶形单元的对称性,降低了Viterbi译码器的实现复杂度.采用SMIC0.13μm CMOS工艺设计并实现了该译码器,在时钟频率为240MHz时,它的最大数据吞吐率为480Mb...
关键词：VITERBI译码器 MB-OFDM UWB WPAN 高吞吐率 低功耗 ASIC 
WiMAX中多码率LDPC解码器的设计与实现被引量：2
《电视技术》2008年第2期59-61,共3页李刚 黑勇 刘志国 仇玉林 
国家自然科学基金项目(60576026)
针对WiMAX中多码率LDPC码,提出一种多码率LDPC解码器结构,并且在FPGA上实现了该解码器。实验结果表明:该解码器完全可以满足IEEE802.16e标准中多码率的实现要求,而且具有高吞吐率、高性能的特点。
关键词：WIMAX标准 IEEE802.16E标准 LDPC解码器 多码率 现场可编程门阵列 
高速除法器设计及ASIC实现被引量：10
《微电子学与计算机》2008年第2期133-135,共3页黄秀荪 叶青 仇玉林 
为提高除法计算的速度,提出了新的基-16算法的高速除法器算法,并以专用集成电路设计方法实现。与MIPS处理器中使用的除法器相比,电路最大延迟减少了27%,计算所需时钟周期数减少了68%,速度性能改善了77%左右。给出了电路的其他性能指标...
关键词：除法 专用集成电路 基-16 
一种高速Viterbi译码器的设计与实现被引量：7
《电子器件》2007年第5期1886-1889,共4页李刚 黑勇 乔树山 仇玉林 
Viterbi算法是卷积码的最优译码算法.设计并实现了一种高速(3,1,7)Viterbi译码器,该译码器由分支度量单元(BMU)、加比选单元(ACSU)、幸存路径存储单元(SMU)、控制单元(CU)组成.在StratixⅡ FPGA上实现、验证了该Viterbi译码器.验证结果...
关键词：VITERBI译码器 高速设计 FPGA AWGN 
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