刘杰

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基于Verilog的随机时钟误差测试平台设计
《吉林大学学报（工学版）》2007年第3期667-671,共5页刘杰 姚素英 史再峰 解晓东 
天津市科委科技重点攻关基金项目(043184511)
结合视频模式识别模块的仿真验证,介绍了一种基于Verilog的随机时钟误差测试平台的设计方法。利用Verilog提供的随机数生成函数,并对其加以改进,生成一组近似高斯分布的随机向量,仿效输入信号的真实行为对模块进行仿真。实验结果表明:...
关键词：电子技术 测试平台 时钟抖动 相位偏差 伪随机测试 
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