廖建波

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基于Verilog HDL的频率计的设计
《萍乡学院学报》2015年第6期25-27,共3页张兴娇 肖永江 廖建波 肖丽丽 
江西省科技计划项目(20133BBE50036)
以Altera公司Cyclone IV系列EP4CE15F17C8N器件为核心,制作了一个宽带高频小信号频率计。该系统将正弦信号通过硬件电路整形、放大、滤波后,用Verilog HDL实现分频、门控、计数、锁存、译码显示等设计,进行数据读取、运算和显示,正弦信...
关键词：频率计 FPGA VERILOG HDL 
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