基于ARM7TDMI的cache控制器电路  

A Cache Controller Circuit Based on ARM7TDMI

作　　者：薛骏[1] 潘江涛[1] 杨军[1] 

机构地区：[1]东南大学国家专用集成电路系统工程技术研究中心,江苏省南京市210096

出　　处：《电子工程师》2004年第12期11-14,共4页Electronic Engineer

基　　金：国家自然科学基金 (60 1760 18);基于低功耗内建自测试的可测性设计方法研究

摘　　要：针对ARM7TDMI内核的特点,提出了一种高速缓存(cache)控制器的电路实现方案。主要应用Verilog硬件描述语言对cache控制器进行了行为级描述,通过了前端仿真和综合后的联合仿真,比较了嵌入式系统中有无cache的工作效率,并给出了实验结果。实验结果表明,系统中加入cache电路以后存储性能会有显著提高。According to design characteristic of ARM7TDMI core, we put forward an circuit implementation of cache controller. In this article we use the verilog HDL to behaviorally describe the cache controller, and pass the front end simulation and back end simulation. Performance benefits are evaluated with Dhrystone benchmarks. At last the experiment result demonstrates its correct function.

关 键 词：前端 VERILOG硬件描述语言 电路实现 ARM7TDMI内核 存储性能 控制器 仿真 高速缓存 嵌入式系统 方案 

分 类 号：TN943.6[电子电信—信号与信息处理] TP332[电子电信—信息与通信工程]