基于Verilog HDL的CDMA并行匹配滤波器设计  

CDMA matched filter implementation based on Verilog HDL

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作  者:杨冬[1] 徐伯庆[1] 

机构地区:[1]上海理工大学光学与电子信息工程学院,上海200093

出  处:《计算机工程与设计》2005年第9期2448-2450,共3页Computer Engineering and Design

摘  要:首先简要介绍了CDMA匹配滤波器工作原理和结构框图,并给出了CDMA匹配滤波器的硬件结构图,在此基础上用Verilog硬件描述语言对CDMA并行匹配滤波器进行了描述,并在Xilinx公司的ModelSim XE II上进行了相应的仿真和验证。Tthe principle of CDMA (Code Division Multiple Access) matched filters was introduced, and the framework for implementing parallel matched filters was given and then CDMA mathched filters was described using Verilog HDL code. The simulating analysis in the ModelSim XE II was completed.

关 键 词:VERILOG CDMA 仿真 EDA 

分 类 号:TN914.53[电子电信—通信与信息系统] TN914.53[电子电信—信息与通信工程]

 

参考文献:

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引证文献:

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