ALL-DIGITAL

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THE DESIGN OF AN ALL-DIGITAL PHASE-LOCKED LOOP WITH LOW JITTER BASED ON ISF ANALYSIS
《Journal of Electronics(China)》2008年第5期673-678,共6页Deng Xiaoying Yang Jun Shi Longxing Chen Xin 
A low jitter All-Digital Phase-Locked Loop （ADPLL） used as a clock generator is designed. The Digital-Controlled Oscillator （DCO） for this ADPLL is a seven-stage ring oscillator with the delay of each stage change...
关键词：All-Digital Phase Locked Loop （ADPLL） Digital Controlled Oscillator （DCO） Impulse Sensitivity Function （ISF） Thermal noise JITTER 
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