时钟抖动

作品数：168被引量：275H指数：9
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一种应用于TDC的低抖动延迟锁相环电路设计被引量：6
《电子学报》2017年第2期452-458,共7页吴金 张有志 赵荣琦 李超 郑丽霞 
江苏省自然科学基金(No.BK2012559);中央高校基本科研业务费专项资金资助;江苏省普通高校研究生科研创新计划资助项目(No.SJLX15_0098)
本文采用双延迟线和防错锁控制结构,结合对电荷泵等关键模块版图对称性的匹配控制,设计了一种针对(Time-to-Digital Converter,TDC)应用的宽动态锁定范围、低静态相位误差延迟锁相环(Delay-Locked Loop,DLL)电路.基于TSMC 0.35μm CMOS...
关键词：延迟锁相环 时间数字转换器 静态相位误差 宽动态范围 时钟抖动 
估算高稳时钟抖动的幂率积分下限的研究被引量：1
《电子学报》2010年第12期2846-2849,共4页曹鹏 王明飞 费元春 
北京市自然科学基金重点项目(No.KZ201010015013);北京市学术创新团队项目(No.06020109002);北京市人才强教项目(No.06170107018)
幂律积分法是估算亚皮秒级时钟信号抖动所采用的一种常用方法.该方法的换算结果与积分区间有关,尤其与积分下限有关.通过对幂律积分法将相位噪声转换为抖动的关系式介绍,推导了幂律积分下限与采样时钟的频率、被采样模拟信号的最高频率...
关键词：抖动 相噪 功率谱密度 幂率积分 中频采样 
一种新型高精度DLL鉴相器设计被引量：4
《电子学报》2009年第8期1694-1698,共5页冀蓉 冯颖劼 曾献君 陈亮 张峻峰 罗钢 
国家自然科学基金(No.60676016)
本文从研究静态相位误差对DLL(Delay-Locked Loop)环路的影响入手,基于Hogge和Alexander结构鉴相器,设计了一款用于30相500MHz DLL的新型高精度鉴相器.与传统的线性鉴相器和二进制鉴相器相比,文中提出的新型鉴相器电路既具有理想线性鉴...
关键词：鉴相器 延迟锁相环 相位误差 时钟相位 时钟抖动 
全数字接收机中插值滤波器的优化设计被引量：1
《电子学报》1996年第10期123-126,128,共5页樊平毅 冯重熙 
本文讨论了全数字接收机中插值滤波器的优化设计问题。利用插值公式的截断式导出码间串扰量的度量式，研究了其收敛特性。利用码间串扰量的度量准则，对不同的成形滤波函数研究了插值滤波器的参数优化估计及其抗时钟抖动性能。
关键词：全数字接收机 插值滤波器 成形滤波 时钟抖动 
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