系统内编程

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运算器与逻辑部件
《电子科技文摘》2000年第7期104-105,共2页
Y2000-62094-358 0011974高速可测试加法器采用冗余去除的高级设计综合=High-level design synthesis with redundancy removal forhigh speed testable adders[会,英]/Wagh,M.& Chen,C,-I.//1999 IEEE International Symposium on Circ...
关键词：高密度可编程逻辑器件 方法论 行为综合 异步系统 加法器 系统内编程 级设计 现场编程 逻辑部件 运算器 
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