静态时序分析

作品数：112被引量：141H指数：6
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RapidIO交换芯片的静态时序约束设计被引量：1
《现代电子技术》2023年第4期1-6,共6页张丽 沈剑良 李沛杰 
国家科技重大专项核高基资助项目(2016ZX01012101)。
静态时序分析是目前通用的芯片时序验证的重要方法,其依赖于时序模型和时序约束。时序约束是检验设计电路时序的准则,好的时序约束可以正确地体现芯片的设计需求。针对RapidIO交换芯片中存在的多时钟域构成、高速通道的高速时钟频率要求...
关键词：静态时序分析 时序约束 RapidIO交换芯片 时序收敛 时钟同步 时钟约束 
微处理器设计中的时序验证及优化被引量：2
《现代电子技术》2012年第8期147-149,153,共4页朱宇耀 苏凯雄 陈建 
福建省科技重大专题专项目(2009HZ0003-12010HZ0004-1);福建省科技厅重大专项(2011H6015)
为了解决微处理器设计中时序验证和性能优化问题,采取可综合代码设计到静态时序分析过程中针对关键路径进行处理的策略,完成了系统性能优化的完整流程。理论分析和实践结果证明,根据RTL级的静态时序分析结果进行系统关键路径的优化,可...
关键词：微处理器 关键路径 可综合代码设计 静态时序分析 
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