加扰器

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基于JESD204B协议支持大/小端模式的加扰器
《微电子学》2019年第5期637-642,共6页姚佳 蒲杰 何基 吴燕青 
模拟集成电路国家重点实验室基金资助项目(6142802WD201805)
设计了一种基于JESD204B协议、支持大/小端模式且具有旁路能力的四字节并行加扰器。在并行加扰/解扰原理的基础上,采用四字节并行处理技术,加快了扰码的产生效率。该加扰器支持大/小端模式,根据不同需求可自行选择不同模式。采用Verilog...
关键词:JESD204B协议 大/小端模式 加扰器 
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