T-MMB系统中LDPC码译码器的FPGA设计与实现  

FPGA Design and Implementation of LDPC Decoder Based on Mobile-Multimedia-Broadcasting System

作　　者：柳晓凤[1] 李媛[1] 韩康康[1] 

机构地区：[1]天津大学电子信息工程学院,天津300072

出　　处：《电子产品世界》2013年第7期53-55,67,共4页Electronic Engineering & Product World

摘　　要：本文设计了一种符合手机电视T-MMB标准的信道译码解决方案,并进行了MATLAB仿真和FPGA的实现。同时针对部分并行结构的准循环低密度校验(QC-LDPC)码译码器,提出了基于块RAM的高效存储方法。该方法既可以同时读取用于运算的校验节点信息或变量节点信息,又可以实现在同一块RAM中存储不同子矩阵对应的校验节点信息或变量节点信息,不仅避免了块RAM资源的浪费,而且减少了译码器实现所需的存储资源数量。在Xilinx公司Virtex-4系列的FPGA上的实现结果表明,与传统的子矩阵与块RAM一对一存储的译码结构相比,本文提出的QC-LDPC码译码器设计方法能够在减少块RAM数量的同时有效地提高系统的时钟频率和译码吞吐量。

关 键 词：LDPC码 T—MMB系统 译码器 FPGA实现 高效存储 

分 类 号：TN911.22[电子电信—通信与信息系统] TN791[电子电信—信息与通信工程]