译码器

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基于辅助去噪的极化码网络级联改进译码算法
《西安邮电大学学报》2025年第2期1-8,共8页李卓 赵紫涵 邢莉娟 苟旭 
国家自然科学基金项目(61372072);111工程基金项目(B08038)。
针对现有网络译码器在极化码译码中存在训练集数据要求较为严苛且抗噪声能力较弱的问题,提出一种基于辅助去噪的极化码网络级联改进译码算法。将卷积神经网络(Convolutional Neural Network,CNN)用于去噪,门控循环单元(Gated Recurrent ...
关键词：极化码译码 卷积神经网络 辅助去噪 网络译码器 扰动参数 
多调制方式兼容的BCH概率软译码器的FPGA实现
《微电子学与计算机》2025年第3期75-83,共9页庞宇 张洋 李国权 杨家斌 
国家自然科学基金(61671091)。
为实现在复杂环境下多种人体体征参数的高可靠性传输,设计了一种基于现场可编程逻辑门阵列(Field Programmable Gate Array,FPGA)的BCH概率软译码器。译码器利用概率计算的方式替换Chase算法中的大量排序运算,并利用8位循环冗余校验(Cyc...
关键词：BCH码 软译码 概率计算 FPGA 
Boom Box 3遥爆系统与电子雷管在G3i仪器中的应用
《物探装备》2025年第1期49-51,共3页李伟利 蒋福罡 周成宽 邢永强 米辉 
本文详细介绍了Boom Box 3遥爆系统,MAXAM电子雷管与G3i仪器联机使用时编码器的改进与取得的市场成果;Boom Box 3编码器与G3i仪器硬件接口的连接方法和注意事项;Boom Box 3编码器译码器软件的关键参数设置及含义;G3i仪器的软件的关键参...
关键词：Boom Box3 G3i仪器 电子雷管 编译码器 
基于非均匀量化的极化码SCL译码器FPGA实现
《无线电通信技术》2024年第6期1200-1208,共9页魏少圣 熊启金 郑绍华 陈平平 
国家自然科学基金面上项目(62171135)。
针对现有均匀量化的连续消除列表(Successive Cancellation List,SCL)译码算法中存储资源消耗大、布线延迟高的问题,提出了一种采用5 bit非均匀量化方案的SCL译码算法。该算法保留均匀量化中的对数似然比(Log-Likelihood Ratio,LLR)迭...
关键词：极化码 连续消除列表译码 非均匀量化 现场可编程逻辑门阵列 
基于RS编译码器的NAND FLASH纠错系统设计与实现
《舰船电子工程》2024年第12期121-125,140,共6页董天 张会新 
国家自然科学基金项目(编号:51705475)资助。
针对某国产型号NAND FLASH在数据读写过程中因外部噪声干扰而引入误码的严峻挑战,文章研究并设计了一种基于RS(Reed Solomon)编译码核的NAND FLASH纠错方案,旨在提高数据传输的可靠性和准确性。设计采用国微SM29F128G08SDM型号128 GB大...
关键词：NAND FLASH 误码率 RS编译码 纠错机制 
基于概率计算的多进制LDPC译码器设计
《移动通信》2024年第12期116-121,共6页罗瑞 周明军 郑斌 曾令昕 李丽仙 申望君 庞宇 王勇 
重庆市自然科学基金创新发展联合基金(CSTB2023NSCQLZX0107)。
LDPC码以其逼近香农极限的卓越性能,在多种通信标准中得到了广泛应用。现有的LDPC软判决译码算法虽然具有优异的译码性能,但由于其内部包含大量乘法等计算复杂度高的运算,导致这些算法在硬件实现上难度较大,资源消耗过高,进而造成资源...
关键词：低密度奇偶校验码 概率计算 软判决 译码算法 
极低信噪比下分层归一化QC-Hadamard-LDPC译码器设计
《微电子学与计算机》2024年第11期75-82,共8页肖磊 
四川省自然科学基金(2022NSFSC0905)。
传统LDPC码在低信噪比环境下性能较差,借助Hadamard约束构造的Hadamard-LDPC码是一类可逼近香农极限的低码率码字。但是Hadamard-LDPC译码常常采用基于符号最大后验概率的方法,译码过程存在大量指数、对数等非线性运算,计算复杂度高、...
关键词：QC-Hadamard-LDPC码 分层归一化译码 Max-Log-MAP规则 FPGA 
基于工业生产需要的数字频率检测计设计与实现
《电脑编程技巧与维护》2024年第11期15-19,共5页王海荣 李岑岑 戎依行 张榕 
研究介绍了基于工业生产的数字频率检测计的设计原理和应用,以及如何使用数字电路逻辑系统搭建一个由分立元件组成的系统来实现频率测量。该系统采用三级分频的方法得到4个时基信号,并通过数字选择器选择所需的量程。信号经过放大和整形...
关键词：分立元件 时基信号 数字电路 三级分频 计数器 译码器 施密特触发器 
基于GPU的LDPC译码器设计
《电子质量》2024年第10期43-48,共6页黄柯文 刘世刚 汪洋 
为了提高低密度奇偶校验码(LDPC)译码器的译码速度,提出了一种基于图形处理单元(GPU)加速的并行LDPC译码方案。该方案基于对数似然比(LLR-BP)译码算法进行设计,针对算法的可并行部分采用并行度更高的边并行译码方案,以降低译码延迟并提...
关键词：图形处理单元 低密度奇偶校验码译码器 数据协调 并行计算 
LDPC编译码器设计与FPGA实现
《电子制作》2024年第17期3-6,41,共5页吴逍 李宇鹏 薛佳欣 
国家自然科学基金(61901301)。
设计了基于CCSDS标准下的码字为(8176,7154)、码率为7/8的低密度奇偶校验码(LDPC)的编码器和译码器,并在FPGA开发板上进行了硬件实现。基于直接编码理论,用伪随机序列发生器产生信息位进行编码,以循环移位寄存器为编码器的核心,采取移...
关键词：LDPC码 编码器 译码器 比特翻转译码 FPGA 
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