面向全数字锁相环应用的时间数字转换器  

All-digital phase-locked loop oriented time-to-digital converters

作　　者：张孝[1] 马卓[1] 谢伦国[1] 余金山[1] 袁珩洲 王志强[1] 

机构地区：[1]国防科学技术大学计算机学院,湖南长沙410073

出　　处：《计算机工程与科学》2015年第7期1252-1257,共6页Computer Engineering & Science

基　　金：国家自然科学基金资助项目(61176030)

摘　　要：时间数字转换器TDC是全数字锁相环ADPLL相位捕获的重要部件。以TDC分辨率的提升为主线,讨论了计数器型、门延迟和亚门延迟型三类全数字TDC的基本结构,从提高分辨率、增加动态范围、减小非线性误差等技术点对比阐述各自的优势,并对TDC技术在全数字锁相环中的应用前景以及未来研究重点进行了简要分析。Time-to-Digital Converter （TDC） is an important component of the all-digital phase-locked loop （ADPLL）, which plays the role of phase-frequency detector. This paper focuses on the enhance- ment of all-digital TDC resolution. We present the basic structures of three categories of all-digital TDC, which are counter based TDC,gate-delay-line based TDC and sub-gate delay TDC. We also demonstrate their respective advantages from the aspects of resolution, dynamic range, non-linearity and etc. Finally, we summarize and make projection on future research priorities.

关 键 词：时间数字转换器 分辨率 动态范围 全数字锁相环 

分 类 号：TN45[电子电信—微电子学与固体电子学]