异步计数器

作品数：34被引量：16H指数：3
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相关作者：杨世铎陈招娣时龙兴张萌吉新春更多>>
相关机构：东南大学北京中电华大电子设计有限责任公司中国科学院微电子研究所上海艾为电子技术股份有限公司更多>>
相关期刊：《杭州师范大学学报（社会科学版）》《常州工学院学报》《软件导刊》《益阳职业技术学院学报》更多>>
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异步六十进制计数器的设计与实现
《河南科技》2024年第9期5-8,共4页史占花 
【目的】在数字电子技术的教学中,集成计数器的设计是教学的重点和难点。为了便于学生快速准确地完成计数器的设计,加强设计思维的训练,设计了六十进制异步级联加计数器。【方法】选用集成计数器74LS161D,采用反馈预置法和组合逻辑电路...
关键词：集成计数器74LS161 设计 六十进制异步计数器 仿真 实践 
由触发器构成的异步计数器的一种新分析方法
《山西电子技术》2020年第2期39-41,共3页赵显红 张晓红 张立文 
提出一种新的由触发器构成的异步计数器的分析方法,将计数器的时钟信号作为输入条件写入原触发器的驱动方程构成新的驱动方程,代入触发器的特征方程获得次态方程;将次态方程化为状态变量的最小项之和的标准形式,在不需要进行任何逻辑运...
关键词：计数器 异步时序逻辑电路 触发器 次态方程 真值表 
基于计数器级联构成大容量计数器研究与实践被引量：1
《现代电子技术》2013年第18期131-133,共3页胡桃生 
中央财政支持高等职业学校提升机电一体化技术专业服务产业发展能力项目
在数字系统中,使用得最多的时序电路是计数器。计数器不仅能用于对时序脉冲计数,还可以用于分频、定时、产生节拍脉冲和脉冲序列以及进行数字运算等。实际应用时如需大容量计数器,可通过级联的方式进行扩大。对MSI中规模计数器芯片扩大...
关键词：同步计数器 异步计数器 级联 大容量计数器 
用波形图法分析时序逻辑电路
《电子制作》2013年第8X期15-16,共2页李松柏 
本文运用波形图法分析时序逻辑电路,具有简单明了、易懂的优点。
关键词：触发器 状态图 自启动 异步计数器 同步计数器 
使用Proteus仿真分析异步计数器
《凯里学院学报》2011年第6期31-32,共2页张定祥 
以Proteus仿真软件为基础,介绍它在数字电子线路中的使用,了解仿真软件给电子技术的学习带来的优势和方便,展现多媒体教学的特点.
关键词：异步计数器 图表分析 延迟 
一种基于延时优化的异步计数器设计
《电脑知识与技术（过刊）》2010年第9X期7398-7399,共2页王江舟 
在数字电路设计中异步计数器常常会遇到延时的困扰;介绍了一种异步计数器的设计方法,可以减少延时,使异步计数器能在高频电路中工作。
关键词：异步计数器 时钟延时 低功耗 卡诺图 触发器 
基于异步计数器的实验探究被引量：5
《实验科学与技术》2008年第6期18-21,共4页孙红 
计数器是数字系统中必不可少的组成部分,和同步计数器不同,组成异步计数器的触发器不是共用同一个时钟源,所以触发器的翻转是异步的。该文对异步计数器的逻辑功能以及异步计数器的级联扩展进行探讨,旨在使学生掌握应用异步计数器进行电...
关键词：计数器 异步计数器 触发器 级联 
用Verilog设计实现异步双向计数器
《软件导刊》2008年第10期118-120,共3页孙波 吴亮 
介绍了一种利用Verilog设计实现异步双向计数的方法,给出了主要的可综合Verilog代码,通过仿真验证,可以实现双向计数、异步置数、清零等功能,达到了设计要求。
关键词：异步计数器 VERILOG FPGA 
异步计数器设计的关键
《甘肃科技纵横》2008年第5期59-59,124,共2页姚旦生 
在异步计数器的设计中,要把握住两个关键问题:一个是各触发器时钟信号的选取,一个是从状态转换图化简整理各触发器的状态方程时卡诺图的正确获取。对此进行了分析并提出了具体的解决方法。
关键词：异步计数器 时钟信号 状态方程 驱动方程 
基于低功耗双边沿D触发器的任意进制异步计数器设计被引量：3
《浙江大学学报（理学版）》2007年第5期524-528,共5页赵敏笑 苏红富 陈偕雄 
从D触发器激励表入手,分别给出了采用单边沿D触发器和双边沿D触发器的2n进制异步加法计数器、减法计数器的设计方法.在此基础上,采用逻辑函数修改技术,通过实例讨论了基于单边沿D触发器和双边沿D触发器的异步任意进制计数器的设计.该设...
关键词：低功耗 双边沿触发器 异步计数器 逻辑函数修改技术 
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