PREPROCESSOR

作品数：8被引量：4H指数：1
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相关领域：自动化与计算机技术更多>>
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2.488 Gbit/s clock and data recovery circuit in 0.35 μm CMOS被引量：1
《Journal of Southeast University(English Edition)》2006年第2期143-147,共5页王欢 王志功 冯军 熊明珍 章丽 
The design of a 2. 488 Gbit/s clock and data recovery （CDR） If for synchronous digital hierarchy （SDH） STM-16 receiver is described. Based on the injected phase-locked loop （IPLL） and D-flip flop architectures, ...
关键词：clock recovery data recovery phase-locked loop （PLL） PREPROCESSOR 
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