功耗延时积

作品数：8被引量：9H指数：2
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64位整数加法器的设计与实现
《微电子学与计算机》2009年第2期32-35,共4页谭全林 邢座程 李少青 陈延仓 
为了提高算术逻辑部件的性能,采用多米诺逻辑和偏斜逻辑门的电路结构,结合并行前缀加法器的优点,设计实现了一款64位高性能整数加法器.根据需要,设计了一种符号扩展电路,使之能够处理带符号操作数的加减法,符号扩展结果可以进行溢出判断...
关键词：并行前缀加法器 多米诺逻辑 偏斜逻辑 功耗延时积 
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