VERILOGHDL语言

作品数：22被引量：54H指数：4
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基于FPGA的H.264帧内预测实现和优化被引量：3
《计算机工程》2012年第7期257-259,262,共4页刘西振 杨静 王威 
国家自然科学基金资助项目(60802027);上海海事大学校基金资助项目(20090124)
在使用硬件电路进行H.264编码时,为提高帧内预测运算速度,减少硬件电路面积,提出一种基于现场可编程门阵列(FPGA)的H.264帧内预测硬件电路的实现和优化解决方案。利用FPGA的并行处理能力和同模式下帧内预测数据冗余对硬件电路进行优化...
关键词：帧内预测 H.264视频编码标准 现场可编程门阵列 硬件结构 VERILOGHDL语言 并行处理 
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