VERILOGHDL语言

作品数：22被引量：54H指数：4
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基于FPGA的无源蜂鸣器音乐播放器的设计与实现被引量：2
《内江科技》2022年第4期42-43,共2页王洪钦 李素芬 吴倩 
本文介绍了基于FPGA设计的无源蜂鸣器的音乐播放,使用无源蜂鸣器在不同频率的脉冲方波信号下来产生基本的音调,采用了VerilogHDL语言进行描述,通过Diamond 3软件和ModelSim进行电路的综合与仿真,并下载到小脚丫MachXO2-4000HC开发板中...
关键词：音乐播放 VERILOGHDL语言 蜂鸣器 脉冲方波 FPGA设计 开发板 无源 
基于FPGA的数字跑表设计
《电子测试》2021年第3期16-18,48,共4页胡一丁 隋丽颖 刘肖楠 何英昊(指导) 
Verilog程序通过综合、适配后形成配置文件,下载到FPGA器件中对FPGA进行配置,使FPGA成为实用的测频模块。通过波形仿真,符合本次设计的要求。最后,通过完整编译后的文件固化到开发板,接上高频信号源,实现了数字跑表的设计。本文详细介...
关键词：数字跑表 FPGA VERILOGHDL语言 
基于FPGA的DDR3 SDRAM高速图像数据采集方法被引量：16
《兵器装备工程学报》2018年第5期108-111,共4页隋旭阳 赖文娟 李健 
为满足高分辨率、高帧频图像处理领域对高速、实时数据采集与缓存的需求,结合Xilinx提供的MIG_v1.9 IP核,利用Verilog HDL语言,设计了DDR3 SDRAM控制器;引入读、写FIFO和读写逻辑控制模块,优化了接口封装;提出了一种基于DDR3 SDRAM存储...
关键词：FPGA DDR3SDRAM 用户接口 数据采集 VERILOGHDL语言 XILINX 
基于VerilogHDL语言的有限状态机设计
《中国电子商情（科技创新）》2014年第5期41-42,共2页王塞博 毛先柏 
有限状态机及其设计技术是实用数字系统设计中的重要组成部分，也是实现高效率、高可靠和高速控制逻辑系统的重要途径。Verilog HDL是一种硬件描述语言，可以在门级和寄存器传输级描述硬件，在算法级对硬件加以描述。状态机是数字系统...
关键词：硬件描述语言 有限状态机 设计技术 VERILOG 逻辑系统 数字系统 抽象思维 语言描述 
基于FPGA的H.264帧内预测实现和优化被引量：3
《计算机工程》2012年第7期257-259,262,共4页刘西振 杨静 王威 
国家自然科学基金资助项目(60802027);上海海事大学校基金资助项目(20090124)
在使用硬件电路进行H.264编码时,为提高帧内预测运算速度,减少硬件电路面积,提出一种基于现场可编程门阵列(FPGA)的H.264帧内预测硬件电路的实现和优化解决方案。利用FPGA的并行处理能力和同模式下帧内预测数据冗余对硬件电路进行优化...
关键词：帧内预测 H.264视频编码标准 现场可编程门阵列 硬件结构 VERILOGHDL语言 并行处理 
基于Verilog HDL语言的QAM调制系统仿真研究被引量：1
《科协论坛（下半月）》2011年第10期67-68,共2页陈晓黎 
在信息化高速发展的今天,由于2G系统及蜂窝网的普及带动了用户数的增加,更加由于3G的上市和4G技术的研发使得目前的通信系统已不能满足用户的需求。而现实的情况是,空中频率资源有限,新的利用有效利用频谱的技术还不成熟。因而,系统容...
关键词：QAM调制 仿真 VERILOGHDL语言 
基于FPGA的卫星地球站ODU监控系统设计
《中国测试》2010年第6期91-93,共3页刘淼 王厚军 李力 
为了能够对卫星地球站ODU进行控制与检测,设计了基于FPGA的卫星信号收发机监控系统。该监控系统能够完成ODU的全部控制功能,并且通过检测24个通道的模拟信号来监视ODU的工作状态,能够以两种通信方式与计算机或控制终端通信。设计中将FPG...
关键词：数据采集和处理系统 ODU监控系统 FPGA技术 VERILOGHDL语言 TES系统 
GPON系统ONU-MAC层下行链路的研究及FPGA设计被引量：2
《中国有线电视》2009年第8期842-846,共5页郑杭波 孟利民 刘磊 赵城 
GPON系统相关协议较复杂、实现难度大、涉及面广,所以在设计过程中采用分层的设计方法。针对GPON的分层结构,在原有的基础上进一步研究GPON MAC层的关键技术,包括物理媒介相关层(PMD层)、TC(传输汇聚)子层、帧格式、PLOAM信息的操作管...
关键词：GPON MAC层 GEM帧 QUARTUSII ArriaTMGX VERILOGHDL语言 
基于ASIC/SoC的UART核的设计
《微计算机信息》2008年第5期92-93,205,共3页尧勇仕 顾晓峰 于宗光 韩郑生 
国防科技重点实验室基金资助项目:(编号不公开);无锡市科技计划项目-青年科技人才创新创业项目(DA050001)
本文描述了通用异步收发机UART(Universal Asynchronous Receive Transmitter)核的一种优化设计实现的设计流程。通过采用划分功能模块使结构直观清晰并且简化了设计流程。该UART核采用VerilogHDL语言描述其功能,对RTL级实现优化,解决...
关键词：UART SOC VERILOGHDL语言 验证与综合 
ARM和CPLD实现温室多路数据采集控制系统被引量：10
《微计算机信息》2006年第10Z期19-21,262,共4页张侃谕 王亚哲 袁亚丽 
上海市科委重大科技攻关项目(03D219303)
本文针对现代温室控制中数据采集点数多的问题提出了一种基于高性能ARM控制器和CPLD的多路模拟量、数字量采集与控制系统设计方案,并给出了主要软件设计思路和仿真结果。该设计比传统的温室控制方案具有更高的数据处理能力和灵活性。
关键词：温室控制系统 ARM控制器 CPLD VERILOGHDL语言 
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