抽头延迟线

作品数：52被引量：83H指数：5
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基于FPGA的高精度多通道时间数字转换器设计被引量：7
《微电子学》2015年第6期698-701,705,共5页王巍 董永孟 李捷 熊拼搏 周浩 杨正琳 王冠宇 袁军 周玉涛 
国家自然科学基金资助项目(61404019)
采用Xilinx Virtex-5FPGA芯片,实现了一种高精度、多通道时间数字转换器的设计。每个通道配有一条抽头延迟线,每条延迟线由64个快速超前进位链(CARRY4)组成。布线后,延迟线成链状结构紧密排列,有效消除了布线路径带来的误差,降低了积分...
关键词：FPGA 时间数字转换器 抽头延迟线 快速超前进位链 
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