顾清

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供职机构：清华大学信息科学技术学院智能技术与系统国家重点实验室更多>>
发文主题：遗传算法ASIC设计ASIC脉动阵列无失真更多>>
发文领域：电子电信更多>>
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无失真并行数据压缩的脉动阵列ASIC设计
《电子学报》2000年第9期135-136,共2页顾静 帅典勋 顾清 
973国家重点基础研究规划项目基金!(No .G1 9990 32 70 7);国家自然科学基金!(No .697730 37)
本文提出适用于无失真并行数据压缩的超大规模ASIC的逻辑电路设计 .与其他传统的串行或小规模并行无失真数据压缩的硬件或软件方法相比 ,本文的Systolic阵列结构有更好的并行性、实时性和普适性 .对ASIC的时序和功能进行的模拟验证 ,证...
关键词：数据压缩 遗传算法 ASIC 脉动阵列 
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