屈晓楠

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基于多值逻辑的8位条件和加法器
《北京理工大学学报》2012年第6期607-610,616,共5页吴海霞 屈晓楠 赵显利 仲顺安 夏乾斌 
北京理工大学基础研究基金项目(3050012211106);北京理工大学大学生创新项目(101000718)
针对改善算术VLSI系统的性能,提出了一种基于四值逻辑的加法器设计.采用源极耦合动态多值电流模电路,利用条件和算法,设计实现了基于四值逻辑的8-bit加法器.利用HSPICE软件,在0.18μm CMOS工艺下,电源电压为1.8V,时钟频率为100MHz的条件...
关键词：多值逻辑 多值电流模 条件和加法运算 
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