龚彬

作品数：3被引量：31H指数：1
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供职机构：中国工程物理研究院电子工程研究所更多>>
发文主题：HDLCY7C68013芯片CY7C68013VERILOG_HDLVERILOG更多>>
发文领域：自动化与计算机技术电子电信更多>>
发文期刊：《太赫兹科学与电子信息学报》《兵工自动化》更多>>
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基于AADL和SCADE的模型驱动软件设计被引量：1
《太赫兹科学与电子信息学报》2020年第6期1117-1121,共5页刘芮滦 邓杨 龚彬 
模型驱动开发逐渐应用于嵌入式系统的软件设计,在软件设计阶段重点关注的是软件的架构模型和详细功能模型。用于嵌入式系统软件建模的语言和工具很多,其中结构分析与设计语言(AADL)模型可以构建嵌入式软件的架构,高安全性应用开发环境(S...
关键词：AADL模型 SCADE模型 模型驱动开发 嵌入式系统 自动代码生成 
高冲突性证据的软件可信性评估方法被引量：1
《兵工自动化》2019年第2期55-59,共5页陈倩倩 许丽星 龚彬 
中物院十三五重大预研项目(TA060607)
为解决传统基于DS理论的融合算法在处理高冲突证据时,存在将所有证据都视为高冲突证据统一进行修正的问题,提出一种处理证据高冲突性的改进算法。判断证据的冲突程度,只对冲突性较大的证据进行修正,在保证原始证据真实性的基础上对高冲...
关键词：可信软件 评估方法 高冲突证据 证据理论 
USB2.0控制器CY7C68013与FPGA接口的Verilog HDL实现被引量：29
《电子工程师》2007年第7期52-55,共4页谭安菊 龚彬 
USB(通用串行总线)控制器CY7C68013因其数据传输速率快和多样的接口方式为ATA、FPGA(现场可编程门阵列)和DSP(数字信号处理器)等提供了简单和无缝连接接口而得到广泛使用,介绍了此控制器与FPGA接口的控制和HDL(硬件描述语言)实现方法。...
关键词：USB CY7C68013芯片 接口 FPGA VERILOG HDL 
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