锁相环电路

作品数：99被引量：187H指数：6
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基于交叉耦合锁相环电路的自适应干扰抵消器设计
《通信对抗》2024年第3期37-41,50,共6页钱捷 王平 沈飘飘 
针对复杂电磁环境中存在强窄带信号,造成接收机信道饱和从而无法正常工作的问题,介绍了一种基于交叉耦合锁相环(CCPLL)电路的自适应射频干扰抵消器设计。通过CCPLL电路能实现对一个或两个干扰信号的自适应分离和提取,将提取出的干扰信...
关键词：交叉耦合锁相环 自适应干扰抵消器 CCPLL模型仿真 
一起无线电高度表功能失效问题的分析与排除被引量：1
《航空维修与工程》2023年第7期105-107,共3页谢恩阳 
无线电高度表是飞机上重要的自主导航设备之一,能在各种复杂气象条件下准确测量飞行器相对地面的真实高度。无线电高度表测高异常是无线电高度表的多发故障,结合无线电高度表的测高原理,利用故障树分析法,对一起无线电高度表功能失效故...
关键词：调频连续波 钽电容失效 锁相环电路 
一种高性能小数级联型锁相环电路
《微电子学》2022年第6期967-973,共7页滕海林 孟煦 王晓蕾 
国家自然科学基金资助项目(61704043)
提出了一种低抖动、高频率分辨率、快速锁定的小数级联型锁相环。采用倍乘型延迟锁定环和基于和差调制器(DSM)的相位选择器实现小数倍频,并通过级联一个高带宽的整数型锁相环抬升频率且实现对DSM量化噪声的进一步滤除。基于TSMC 65 nm C...
关键词：级联型锁相环 低抖动 高频率分辨率 快速锁定 
基于LMX2306和MAX2607的锁相环电路的设计与实现被引量：1
《电子制作》2020年第17期85-86,84,共3页谢家祖 张翠萍 张鹏 
天津师范大学校级青年基金项目(52XQ1903);校级教改项目(JGYB01218035),(JGYB01218036)。
在现代通信系统中,通讯设备的频率源准确率与稳定程度直接影响着通信的可靠性及稳定性。运用锁相环电路既能够获得较宽的振荡频率范围,又能够实现高频且稳定的正弦信号。本设计依据锁相环工作原理,以温补晶振作为基准频率源,结合锁相芯...
关键词：LMX2306 MAX2607 锁相环 电路设计 
基于单片机的调幅信号处理
《电子产品世界》2020年第5期55-58,共4页杨兴 蒋美琪 
本设计采用IAP15W4K61S4单片机为控制核心,电路由前级低噪声放大器、AGC模块、锁相环、混频器、中频滤波器及放大器、AM解调电路、基带放大器等部分组成。前级输入为10μV-1 mV的小信号,通过低噪声放大器进行调幅处理,处理后的信号与锁...
关键词：IAP15W4K61S4单片机 锁相环电路 混频器电路 中频滤波器电路 检波电路 
射频锁相环电路工作特性仿真与分析被引量：2
《计算机仿真》2020年第3期414-420,共7页孙慧贤 张玉华 李召瑞 
国防预研基金(41404030101、41404030102)。
射频锁相环是一种能够跟踪输入信号相位变化的闭环自动跟踪系统,此类电路具有负反馈闭环特点、系统状态多,工作特性复杂,其故障诊断和定位是无线电设备维修保障中的难点问题。针对上述问题,研究了射频锁相环电路的工作特性与故障定位方...
关键词：射频锁相环电路 电路仿真 工作特性仿真 故障定位 
一种改进VCO电压动态范围的电荷泵锁相环电路
《电子世界》2020年第3期46-47,共2页郭振业 
锁相环(PLL)已经广泛应用于集成电路芯片之中,其功能涵盖了时钟缓冲器,时钟发生器与频率综合等各方面。本文设计了一种改进"电荷泵"电路结构的锁相环电路,相比传统的电荷泵锁相环,它可以扩展"压控振荡器"控制电压的动态范围至85%电源幅...
关键词：控制电压 电荷泵电路 压控振荡器 电流补偿 锁相环电路 动态范围 VCO 
浅谈对锁相环电路的性能分析
《中国科技期刊数据库 工业A》2019年第11期00186-00187,共2页叶晓洁 
锁相环电路是一种可以实现频率跟踪的自动控制电路,是通过对相位的控制来实现对频率的控制,可以实现无误差的频率跟踪。锁相技术是一种相位负反馈控制技术,锁相环电路具有极其优良的性能。
关键词：琐相环电路 主要特点 性能分析 
射频锁相环电路故障仿真与诊断方法被引量：1
《兵器装备工程学报》2019年第2期219-224,共6页孙慧贤 郝晓雪 张玉华 赵斌 
国防预研基金项目(41404030101;41404030102)
提出了一种结合等效电路建模仿真与开环故障隔离的锁相环电路故障诊断定位方法,分析了锁相环电路的工作原理,建立了等效电路模型,仿真分析了各模块在环路正常情况下的输出信号的特性;在开环状态下分析了环路故障的模拟与诊断方法;针对...
关键词：射频锁相环电路 等效电路建模 故障仿真 故障诊断 开环测试 
延迟锁相环电路的结构与原理被引量：1
《计算机产品与流通》2019年第1期94-94,152,共2页卓燕君 
随着现在高速系统的发展,时钟的抖动和偏斜对系统性能的影响越来越严重。由于延迟锁相环(DLL)可以产生不受温度,电压,工艺影响的延迟,因此在高速接口电路中通常采用延迟锁相环(DLL)的设计,用于DRAM,SDRAM等存储器接口中的内外时钟同步...
关键词：延迟锁相环 时序优化 延迟链 
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