处理器架构

作品数：94被引量：52H指数：4
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最坏执行时间分析中的时序异常问题
《计算机研究与发展》2025年第4期1033-1049,共17页蒋滨泽 朱钇宣 陈香兰 龚小航 高银康 李曦 
国家自然科学基金项目(62102383,61976200,62172380);江苏省自然科学基金项目(BK20210123)。
时序异常是一种程序在最坏执行时间(worst-case execution time,WCET)分析中反直觉的时间行为,其特征在于,尽管局部执行速度更快,但整体的执行时间可能会增加,因此WCET分析必须以保守的态度考虑所有可能的执行情况,以确保分析结果的安全...
关键词：最坏执行时间 处理器架构 时序异常 时间可预测 实时系统 
ChipletNP:基于芯粒的敏捷可定制网络处理器架构
《计算机研究与发展》2024年第12期2952-2968,共17页李韬 杨惠 厉俊男 刘汝霖 孙志刚 
国家自然科学基金项目(62002368)。
5G,8K视频等新业务类型不断涌现,使得网络处理器(network processor,NP)的应用场景日趋复杂多样.为满足多样化网络应用在性能、灵活性以及服务质量保证等方面的差异化需求,传统NP试图在片上系统(system on chip,SoC)上集成大量处理器核...
关键词：网络处理器 芯粒技术 敏捷交换 分组处理 异构资源 
PCI总线空间配置原理及具体实现
《民用飞机设计与研究》2024年第1期28-33,共6页王宁 王珍珍 崔西宁 
PCI总线属于处理器系统的局部总线范畴,作为系统总线的延伸,PCI总线的主要目的是为了连接处理器与外部设备。自从PCI总线规范提出以后,迅速得到了广大厂商的认可与推广,进而在处理器体系结构中始终占据着重要的位置。从软件使用的角度来...
关键词：PCI总线 PCI空间配置 PPC处理器架构 
面向典型处理器架构的代码级侧信道仿真特性研究被引量：1
《密码学报》2023年第6期1225-1240,共16页杨光 李东方 沈炜 王纪 刘诗宇 
国防基础科研计划(XX2020204B028)。
为解决传统侧信道分析依赖硬件采集设备、检测流程靠后等问题,研究代码级侧信道仿真分析技术,通过监测记录密码软件代码在处理器运行期间的内存地址、寄存器值等信息,模拟代码执行过程中可能发生的泄漏.本文在已有研究基础上,针对X86、...
关键词：代码级侧信道 处理器架构 软件功耗仿真 
宇航级处理器发展现状与趋势被引量：5
《天地一体化信息网络》2023年第1期50-58,共9页虞志刚 冯旭 陆洲 高吉星 丁文慧 
国家重点研发计划资助项目(No.2020YFB1806000);国家自然科学基金资助项目(No.62201534、No.61931017);复杂电子系统仿真重点实验基金项目(No.614201004032101)。
航天电子系统是航天工程型号的“大脑”,是世界各主要国家竞相发展的核心领域。作为航天电子系统中最核心的器件,宇航级处理器直接影响航天型号的性能、可靠性和安全。在简要介绍航天电子系统的基础上,首先分析国外宇航级处理器架构发...
关键词：航天电子 宇航级处理器 星上处理 处理器架构 
计算机系统结构中的并行计算与多核处理器架构
《电脑乐园》2023年第3期61-63,共3页付梓城 
本文探讨了计算机系统在现代社会中的重要性,强调了其在信息处理、生活方式改变、创新和发展方面的关键作用。介绍了并行计算的概念,包括数据级并行和任务级并行,以及并行计算的优势。详细介绍了多核处理器的定义、工作原理、同步与异...
关键词：计算机系统 并行计算 多核处理器 信息处理 
申威异构众核处理器架构下结构瞬态有限元并行算法
《振动与冲击》2023年第6期152-158,共7页喻高远 楼云锋 李俊杰 金先龙 
国家自然科学基金(11772192)。
根据国产申威异构众核分布式存储计算机的体系结构特点,提出了一种结构瞬态有限元分层并行计算方法,对于提高国产申威异构众核分布式存储并行计算机下大型、超大型复杂结构系统的瞬态并行求解效率具有重要意义。该方法在分层通信和Newma...
关键词：异构众核 分布式存储 分层通信 大规模瞬态分析 并行计算 
快速低切换开销的堆栈处理器架构研究与实现
《计算机工程与设计》2023年第1期292-298,共7页郭金辉 代红兵 周永录 刘宏杰 
国家自然科学基金项目(61640205、61962060)。
为解决当前Forth堆栈处理器架构不支持多任务并发和事件实时响应等问题,提出一种快速低切换开销的Forth堆栈处理器架构。在现有Forth堆栈处理器架构的基础上,引入新的指令、定时器、中断机制以及采用多任务堆栈技术,使得该架构支持实时...
关键词：Forth堆栈处理器 新指令 定时器 多任务堆栈技术 实时多任务 寄存器处理器 
RISC V标准指令集的六级流水线设计被引量：2
《单片机与嵌入式系统应用》2022年第10期36-39,44,共5页张旭 韩跃平 唐道光 武杰 
基于RISC V标准指令集,提出一种六级流水线设计方法。首先,分析了流水线级数对处理器性能的影响,在经典五级流水线的基础上将流水线划分为6个阶段,缩短时延,提高主频。其次,为解决流水线中的冒险问题,采用定向前推和插入纵向气泡的方式...
关键词：RISC V 处理器架构 流水线 数据冒险 
没有经历爆发,RISC-V却活得很精彩
《中国电子商情》2022年第5期42-45,共4页《中国电子商情》编辑部 
一个起源于2010年的精简指令集架构,十余年之后被捧在手心,许多厂商趋之若鹭,未经历爆发的RISC-V将迎来高光时刻?另类的处理器架构或指令集架构并非个例,比如OpenPOWER、OpenSPARC、OpenRISC等。其中,OpenPower是IBM的开源指令集架构,IB...
关键词：精简指令集 数据中心 指令集架构 OPEN RISC IBM Sun公司 处理器架构 
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