指令CACHE

作品数：36被引量：38H指数：4
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一种嵌入式微控制器的指令Cache设计方案
《电子制作》2025年第4期22-25,共4页王睿 张艳花 
在传统的指令Cache设计方案中,VTag存储器大小取决于处理器的总线宽度以及指令Cache的Cache行数和Cache行大小。本文提出了一种优化指令Cache的电路设计,通过减小指令Cache覆盖的取指空间,在不影响指令Cache对外接口的总线宽度以及Cach...
关键词：嵌入式 微控制器 处理器 指令CACHE 
基于指令Cache和寄存器压力的循环展开优化被引量：2
《计算机工程与科学》2022年第12期2111-2119,共9页王翠霞 韩林 刘浩浩 
循环展开是一种常用的编译优化技术,能够有效减少循环开销,提升指令级并行程度和数据局部性,提升循环的执行效能。然而,过度的循环展开会造成指令Cache溢出,增大寄存器压力,循环展开次数太少又会浪费潜在的性能提升机会,因此寻找恰当的...
关键词：编译优化 循环展开 展开因子 指令CACHE 寄存器压力 
基于标志编码的指令Cache低功耗方法被引量：1
《微电子学与计算机》2016年第12期30-33,共4页李泉泉 龚晓华 郭二辉 
国家"核高基"重大专项(2012ZX01034001-001)
针对嵌入式处理器中指令Cache功耗显著的问题,提出了一种基于标志编码的低功耗指令Cache设计方法.通过增加一个容量很小的标志缓冲器来保存内核地址中的标志位,并利用位宽较小的标志编码存储器取代传统指令Cache结构中位宽较大的标志存...
关键词：标志编码 低功耗 指令CACHE 嵌入式处理器 
DSP指令Cache的设计与实现
《电子世界》2016年第21期84-84,87,共2页吕华智 黄嵩人 
为提高DSP处理器的执行效率,专门针对CPU指令处理速度与存储器指令存取速度不匹配问题,本文通过在CPU与主存储器之间设计了一款指令Cache,从而有效解决了上述问题。根据DSP四级流水线的特性,所设计的指令Cache采用直接映像机制;通过veri...
关键词：DSP 指令CACHE Cache控制器 
一种面向超标量处理器的低功耗指令Cache设计
《微电子学与计算机》2015年第7期103-106,111,共5页肖建青 李伟 张洵颖 沈绪榜 
国家"八六三"计划项目(2011AA120204);"十二五"民用航天某预研项目(YY2011-012(D020201))
针对超标量结构中多体并行的流水化指令Cache提出了三种低功耗优化策略,首先是基于Cache路的条件放大技术,它根据标志匹配结果来关闭无关路中敏感放大器对存储阵列的驱动输出;其次是基于Cache行的动态电压调节技术,它只对当前访问的Cach...
关键词：超标量 流水化指令Cache 条件放大 动态电压调节 指令回收 
基于SRAM和STT-RAM的混合指令Cache设计
《计算机工程与应用》2015年第12期43-48,共6页皇甫晓妍 樊晓桠 黄小平 
国家自然科学基金(No.60773223;No.61003037;No.60736012;No.61173047);西北工业大学基础研究基金(No.JC20110224;No.JC201212)
随着工艺尺寸减小,传统基于SRAM的片上Cache的漏电流功耗成指数增长,阻碍了片上Cache容量的增加。基于牺牲者Cache的原理,利用SRAM写速度快,STT-RAM的非易失性、高密度、极低漏电流功耗等特性设计了一种基于SRAM和STT-RAM的混合型指令Ca...
关键词：自旋转移力矩随机存储器(STT-RAM) 指令CACHE 混合Cache 
基于流水化和滑动窗口结构的低功耗指令Cache设计
《计算机工程与科学》2015年第6期1037-1042,共6页李伟 肖建青 
国家863计划资助项目(2011AA120201)
嵌入式处理器中Cache的应用极大地提高了处理器的性能,同时Cache,尤其是指令Cache功耗占据了处理器很大一部分功耗,关闭不必要的tag SRAM和data SRAM的访问,可以极大地降低功耗。提出了一种流水化的指令Cache访问机制,关闭不必要的data ...
关键词：指令CACHE 低功耗 流水化 滑动窗口 CPU 
基于分支执行历史的循环缓冲低功耗方法
《微电子学与计算机》2014年第9期7-10,共4页李泉泉 张铁军 王东辉 侯朝焕 
针对嵌入式处理器中指令Cache功耗显著的特点,提出了一种基于分支执行历史的循环缓冲低功耗方法.利用分支指令当前信息与分支执行历史信息之间的关系,实现了应用程序中循环的动态检测与加载.通过对取指通道的精确控制,该方法能够过滤大...
关键词：分支执行历史 低功耗 循环缓冲 指令CACHE 
采用预测校正的动态可重构指令Cache
《电子学报》2014年第5期982-986,共5页曹向荣 张晓林 
国防科工局航天民用专项;北京市重点学科基金(No.XK100070525)
本文提出一种兼顾性能与功耗的cache最优参数检索算法.通过运行时反馈的cache评价指数,预测校正cache参数检索空间与检索顺序,在保证检索效率的同时,提高结果的准确率.该算法可以减少穷举法近80%的迭代次数;同时以损失部分效率为代价,...
关键词：高速缓冲存诸器 动态重构 预测校正 低功耗 
基于对称多处理机的指令Cache验证策略研究被引量：1
《计算机应用与软件》2013年第11期231-234,共4页谭坚 李岱峰 王俊 王丽一 
指令Cache作为高性能计算机系统中指令代码的高速缓冲,在整个系统中占有重要地位,其正确性验证工作很有必要。针对对称多处理机结构的一级和二级指令Cache验证提出多种验证策略,对各种验证策略造成指令Cache的颠簸效果进行实验和分析,...
关键词：指令CACHE 验证策略 完备 
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