时钟网络

作品数：34被引量：87H指数：4
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一种基于改进K-means算法的高能效时钟网络设计被引量：1
《微电子学与计算机》2023年第8期101-107,共7页潘达杉 黄金明 马超 
本文针对先进处理器中部件级时钟网络设计面临的时钟网络偏斜难控制、时钟负载重动态功耗大的问题,实现了一种高能效局部时钟网络设计方法,提出了基于考虑负载K-means算法的时钟驱动点位置优化算法TKDLO(Timing driven K-means based Dr...
关键词：高能效 时钟网络 低偏斜 K-MEANS 
全数字化M310机组DCS系统时钟网络拆分设计与应用
《仪器仪表用户》2023年第5期82-87,33,共7页张明月 
本文从方家山DCS系统时钟网络出发,研究分析Mesh数据网络架构拆分后DCS一层时钟网络拆分设计,通过DCS系统最小化平台测试验证DCS系统时钟网络拆分可实施性,得到对“一机组运行,一机组停运”下DCS系统影响最小的时钟网络拆分方案。本方...
关键词：核电 DCS 时钟网络 拆分设计 
基于FPGA的SOC原型验证时钟方案研究被引量：1
《中国集成电路》2022年第12期51-55,共5页李文晶 
在基于FPGA的SOC原型验证过程中,由于SOC芯片的时钟网络比较庞大并且复杂,不能直接用在FPGA芯片上,所以需要对原型验证时钟方案进行研究。本文针对SOC芯片原型验证的时钟方案,从时钟网络简化、多片FPGA时钟同步、门控时钟转换和时钟降...
关键词：SOC原型验证 FPGA 时钟网络 时钟同步 门控时钟 时钟降频 
基于国产元器件的信号处理平台设计被引量：1
《数字技术与应用》2022年第10期231-233,共3页朱业腾 王玉斐 范云龙 
本文提出了一种基于国产化多核DSP+FPGA架构的信号处理平台的设计方案。分析了国产DSP、FPGA等核心器件的功能、性能特点,阐述了核心器件外围电路、电源网络、时钟网络等设计方法。经性能测试及实际应用验证,该信号处理平台运算性能优秀...
关键词：信号处理平台 电源网络 时钟网络 运算性能 外围电路 核心器件 性能测试 国产元器件 
高性能众核处理器芯片时钟网络设计被引量：3
《计算机工程》2022年第8期25-29,36,共6页马永飞 高成振 黄金明 李研 
“核高基”重大专项“超级计算机处理器研制”(2017ZX01028-101)。
随着芯片工艺演进与设计规模增加,高性能众核处理器芯片时钟网络设计面临时序和功耗的全方位挑战。为降低芯片时钟网络功耗并缓解时钟网络分布受片上偏差影响导致的时钟偏斜,在H-Tree+MESH混合时钟网络结构的基础上,结合新一代众核处理...
关键词：高性能众核处理器芯片 时钟网络 时钟功耗 时钟偏斜 多源时钟树综合 
高速电流舵数模转换器减小时序失配的方法被引量：1
《中国科学：信息科学》2022年第4期675-686,共12页付裕深 黄成宇 孙立猛 李学清 杨华中 
国家自然科学基金(批准号:61934009)资助项目。
随着电流舵数模转换器(digital-to-analog converter,DAC)工作频率的提高,即使是数百飞秒的时序失配也会严重恶化高性能DAC的动态性能.在这一类DAC中,锁存驱动器模块直接控制电流源的开关切换,其时序直接影响电流舵DAC输出模拟信号的码...
关键词：时序失配 数模转换器(DAC) 时钟网络 梯度失配 随机失配 无杂散动态范围(SFDR) 
基于时钟网络的高速数据采集与处理系统设计被引量：2
《太赫兹科学与电子信息学报》2021年第2期228-234,共7页富帅 倪建军 闫静纯 于双江 刘涛 
针对全波形激光雷达中高速率数据采集系统的需求,研制了一种基于时钟网络的高速数据采集与处理系统,对其中的关键技术进行了研究。在对FPGA片同步技术及时钟抖动机理进行分析的基础上,提出一种以锁相环和时钟缓冲器为主要构建单元的高...
关键词：激光测距 全波形 高速数据采集 时钟网络 
英国宣布立项7个量子项目NPL参与多项
《中国计量》2021年第4期56-57,共2页
2021年1月13日,英国研究与创新署(UKRI)宣布立项7个项目,总额3100万英镑,利用尖端量子技术进行早期宇宙和黑洞、暗物质等基础物理学研究。这批项目由总额8.3亿英镑、专门支持多学科和跨学科研究的战略优先基金支持。具体项目清单如下:1....
关键词：暗物质 早期宇宙 项目清单 量子技术 黑洞 时钟网络 基金支持 研究与创新 
多核片上系统时钟网络结构模型与仿真分析被引量：1
《测控技术》2017年第8期94-98,共5页余乐 王瑶 陈岩 吴超 李洋洋 李阳光 
北京市自然科学基金资助项目(4174086);国家自然科学基金资助项目(61473009)
对多核片上系统(MPSoC)而言,随着集成度和性能的提升,时钟网络的结构愈发重要。研究了基于结构建模的多路全局/局域时钟网络的结构建模与分析。通过建立多级级联,分别从主干、支干和接入三层对时钟网络的结构进行建模。针对运算单元接...
关键词：多核片上系统 时钟网络 仿真分析 
基于参数化模型的FPGA时钟网络设计和优化被引量：1
《电子学报》2017年第7期1686-1694,共9页余乐 陈岩 李洋洋 吴超 王瑶 苏童 谢元禄 
北京市自然科学基金(No.4174086)
本文在FPGA时钟网络(Clock Distributed Network,CDN)关键结构尺寸的参数化建模基础上,提出一种针对全定制FPGA CDN的设计和优化方法.本文所建立的参数化模型将结构尺寸分为拓扑结构和电路与互连两类,分别给出了这两类尺寸参数的设计原...
关键词：FPGA 时钟网络 参数化 建模 
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