数据宽度

作品数：17被引量：29H指数：2
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多核DNN处理器访存指令数据宽度的混合策略
《计算机应用文摘》2022年第18期81-83,共3页刘元旭 张方正 王永昶 王宝生 
中国高校基本科研业务费项目(北京交通大学K20JB500070)。
近年来,深度神经网络(Deep Neural Network,DNN)在计算机视觉等领域获得了广泛应用。DNN任务具有访存密集的特点,对于基于片上网络(Network-on-Chip,NoC)架构的多核DNN处理器,当前的内存访问指令(load-store指令)的数据宽度的访存效率...
关键词：DNN处理器 片上网络 访存指令 混合访存数据宽度 
三值光计算机高数据宽度的管理路径探究
《新教育时代（电子杂志）》2015年第10期31-31,共1页曾玉林 
数据宽度高是光学计算机的特征之一，本文以计算机操作系统内存管理的方法为思路，针对360位三值光计算机处理器模型进行了高数据宽度管理路径探究，并将算位和算道及其类型重新定义，保证了管理路径的可行性。
关键词：三值光计算机 数据宽度 管理路径 
基于增加数据宽度的方法提高访存速度
《微处理机》2014年第6期78-79,84,共3页闫庚哲 
低效率的访存操作是限制微处理器性能提高的一个关键因素。因此提高访存速度可以有效改善微处理器的性能。提出了一种基于增加数据宽度的方式来提高访存速度的方法。通过使用多字宽存储器来增加数据带宽,降低失效开销的时钟周期,从而达...
关键词：数据宽度 多字宽存储器 访存速度 
小数乘法器的低功耗设计与实现被引量：1
《数据采集与处理》2013年第3期376-381,共6页袁博 刘红侠 
国家自然科学基金(60976068)资助项目;教育部科技创新工程重大项目培育资金(708083)资助项目;教育部博士点基金(200807010010)资助项目
提出一种针对小数乘法器的低功耗设计算法,其优化指标为综合后小数乘法器内部寄存中间运算结果的寄存器位宽,解决了目前低功耗设计中算法自身逻辑单元被引入系统从而降低系统优化效果的问题。该算法能够在不降低系统工作效率、不损失系...
关键词：小数乘法器 低功耗设计 数据宽度 优化逻辑 
9600bit／s半双工无线串口的制作
《无线电》2013年第4期28-31,共4页张彬杰 
当我还在学校上学的时候，就想编写程序．让信息在两台计算机之间传递．如果能够无蚓专输那就更好了。那时候仅仅是想想．因为当时的我甚至连串口是什么都不知道。后来学了51单片机才升始明白，单片机和计算机上都有个叫串U的接口，传...
关键词：串口 双工无线 51单片机 制作 计算机 编写程序 数据宽度 信息 
Win8来了 该装32位还是64位?
《计算机与网络》2012年第17期26-27,共2页
如今安装Win8已经不是什么新鲜事儿了．如果你还没有装Windows8．那未免也太Out了。
关键词：WIN8 操作系统 计算机技术 数据宽度 
NEC电子发布图像识别用并行处理器“IMAPCAR2”
《汽车与配件》2009年第1期11-11,共1页
NEC电子日前运用NEC中央研究所的并行处理技术，完成了4款用于汽车辅助驾驶系统等的图像识别芯片的开发，并以“IMAPCAR2”的产品名从2009年上半期开始提供样品。此次推出的新产品是IMAPCAR的后续产品。新产品的主要特征有：（1）128个...
关键词：图像识别 NEC 并行处理器 并行处理技术 辅助驾驶系统 数据宽度 
三值光计算机高数据宽度的管理策略被引量：20
《上海大学学报（自然科学版）》2007年第5期519-523,共5页金翊 
国家自然科学基金资助项目(60473008);上海市高校科技发展基金资助项目(04AB38)
光学计算机必将拥有很高的数据宽度,以刚刚建成的360位三值光计算机运算器模型为背景,就高数据宽度的管理问题提出了6项基本策略.为建立这些策略,定义了算位、算道、算位类型和算道类型等新概念.这组管理策略借鉴了现行计算机操作系统...
关键词：三值光计算机 数据宽度 监控程序 
64位技术带给PC什么?
《网络与信息》2005年第10期46-46,共1页
关键词：64位技术 精简指令集计算机 PC 处理器 GPRS 数据宽度 RISC 32位 CPU 
总线数据宽度可配置DDR传输的FPGA设计与实现被引量：1
《计算机工程与应用》2005年第12期102-103,115,共3页刘勤让 邬江兴 
国家"十五"863信息技术领域重大专项课题(编号:2001AA121011)
随着FPGA开发规模和内部集成度的不断提升,FPGA通常需要控制多个外部芯片,导致FPGA的管脚资源在设计中变得越来越宝贵,文章给出了一种利用总线数据DDR传输的设计方式来减少管脚的使用,提出了一种总线宽度可配置的通用实现模块思想,并给...
关键词：DDR FPGA 时序 
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