VERILOG_HDL

作品数:231被引量:451H指数:9
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基于Verilog HDL的异步FIFO设计被引量:4
《电子设计工程》2021年第19期107-111,116,共6页李红科 王庆春 余顺园 
国家自然科学基金青年基金项目(61801005);安康学院2019年教育教学改革研究项目(ZB201902)。
针对解决SOC内部跨时钟域之间数据传输、存储所引起的亚稳态问题,采用异步FIFO,它是解决集成电路亚稳态的有效方法之一。文中分析了异步FIFO设计中的2个关键性技术难点:减少亚稳态出现概率和正确产生空/满状态标志位。采用一种新的设计...
关键词:异步FIFO 同步器 亚稳态 空/满状态 
基于Verilog HDL的通用UART模块设计与实现被引量:7
《电子设计工程》2020年第8期174-179,共6页吕阳 刘莉娜 郑良广 侯晓伟 
科技部国家重点研发计划(2016YFB1200401);宁波市工业重大科技专项(2017B10017)。
针对工业控制器等对异步串行通讯应用的广泛需求,基于Verilog HDL语言设计了一种波特率、校验类型、帧长度等参数可灵活配置的UART模块,并采用Modelsim进行了行为级的功能仿真。同时搭建了基于FPGA器件的硬件环境,采用CPLD器件的通讯插...
关键词:HDL UART 波特率 校验类型 帧长度 
基于Verilog HDL的SVPWM算法的设计与仿真被引量:1
《电子设计工程》2015年第9期190-192,共3页李琴 任海兰 
空间矢量脉宽调制算法是电压型逆变器控制方面的研究热点,广泛应用于三相电力系统中。基于硬件的FPGA/CPLD芯片能满足该算法对处理速度、实时性、可靠性较高的要求,本文利用Verilog HDL实现空间矢量脉宽调制算法,设计24矢量7段式的实现...
关键词:空间矢量脉宽调制 交流永磁同步电动机 电压型逆变器 VERILOG HDL 
SVN在Verilog HDL开发过程中的应用
《电子设计工程》2014年第5期17-19,22,共4页丁晴 杨晨 丁召 秦鲁东 
贵州省科学技术基金(黔科合J字[2013]2129号)
Verilog HDL是最为流行的硬件描述语言之一。在其开发过程中,存在参与人员多,程序变更混乱等问题,因此,选择合适的版本控制工具是很有必要的。通过分析版本控制工具SVN的特性,提出利用SVN版本控制系统对Verilog HDL开发过程进行管理,以...
关键词:VERILOG HDL 版本控制 SVN 团队协作 
基于CycloneⅢ构成的RS编码系统
《电子设计工程》2012年第4期189-192,共4页苗鑫 邓攀 殷奎喜 
本文采用Altera公司的FPGA器件Cyclone Ⅲ系列EP3C10作为核心器件构成了R-S(255,223)编码系统;利用Quartus Ⅱ 9.0作为硬件仿真平台,用硬件描述语言Verilog_HDL实现编程,并且通过JTAG接口与EP3C10连接。R-S(Reed-Solomon)码是一类纠错...
关键词:CycloneⅢ QuartusⅡ9.0 VERILOG_HDL R—S(255 223).码 
基于Verilog HDL的UART模块设计与仿真被引量:2
《电子设计工程》2010年第5期155-157,共3页魏巍 赵红东 
通用异步收发器UART常用于微机和外设之间的数据交换,针对UART的特点,提出了一种基于Verilog HDL的UART设计方法。采用自顶向下的设计路线,结合状态机的描述形式,使用硬件描述语言设计UART的顶层模块及各个子模块,从而使整个设计更加紧...
关键词:VERILOG HDL 通用异步收发器(UART) 状态机 仿真 
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