LDPC编码

作品数：165被引量：279H指数：7
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基于DVB-S2的通用LDPC编码器的FPGA设计被引量：2
《电视技术》2013年第1期1-3,7,共4页闫国强 王勇 植涌 程伟丽 
针对DVB-S2标准中的LDPC码编码器,提出了一种基于FPGA的通用LDPC编码器设计,该编码器具有多码率通用的特点,并且利用IPCORE构造出多个ROM和RAM,实现了在同一信息位输入时所有与之关联校验位的并行处理,提高了编码速度。经试验测试表明,...
关键词：DVB-S2 现场可编程门阵列 通用编码器 低密度奇偶校验码 
LDPC编码的自适应放大转发协作通信方案被引量：1
《电视技术》2012年第15期87-89,119,共4页刘焕兵 严晓兰 姜晖 陈翔 
国家自然科学基金项目(61040007)
针对放大转发协作通信系统中,中继放大功率倍数固定导致系统功率效率较低的问题,提出了一种低密度奇偶校验码(LDPC)编码的自适应调整放大倍数的放大转发算法,在保证一定的误码率要求的前提下,最大化地提高系统功率效率。仿真结果表明,...
关键词：用户间协作 放大转发 互信息模型 协作通信 低密度奇偶校验码 
面向IEEE 802.16e的高效LDPC编码器设计
《电视技术》2012年第21期128-131,共4页李书洋 胡剑浩 陈杰男 
国家自然科学基金项目(61076096;61101033)
基于矩阵乘法的高斯消元法提出了一种通用的LDPC编码器结构,该结构使用移位寄存器和简单的选线实现了复杂的矩阵向量相乘运算并且不需要存储庞大的校验矩阵。然后根据IEEE 802.16e标准中对校验矩阵的定义,利用FPGA实现了编码器的硬件结...
关键词：LDPC编码 高斯消元法 移位寄存器 IEEE 802.16e 
符合CCSDS标准的动态可重构LDPC编码器的FPGA设计
《电视技术》2012年第21期59-62,70,共5页邱鹏文 柏鹏 李明阳 
CCSDS标准的LDPC生成矩阵具有分块循环特征,并且各种码率的生成矩阵的校验部分都可以分解为8×x的形式,提出利用CCSDS标准的LDPC的特点设计动态可重构LDPC编码器。首先提出了LDPC编码器码速率重构的4种模型,然后分析了功能重构的关键技...
关键词：分块循环 可重构LDPC编码器 码速率重构 功能重构 
LDPC编码中大矩阵求逆及存储的一些方法被引量：3
《电视技术》2010年第9期4-6,共3页许帮保 刘春江 郭沛宇 王昱 
"十一五"国家科技支撑计划重点项目(2008BAH22B02)
低密度奇偶校验(LDPC)码在CMMB、DVB-S2及地面数字电视国家标准(GB20600-2006)等标准中得到了广泛的应用,LDPC码在码长较长时优势才比较明显,而在进行编码运算时码长较长会遇到大矩阵求逆及存储方面的问题,就此提出一些大矩阵求逆及存...
关键词：低密度奇偶校验码 中国移动多媒体广播 逆矩阵 编码 
DTMB发射机LDPC编码器的设计与优化被引量：5
《电视技术》2008年第7期4-5,19,共3页杨抒文 彭克武 潘长勇 
教育部新世纪优秀人才支持计划;欧盟第六框架国际合作项目(045461)
介绍了中国数字电视地面传输标准中基于累加移位寄存器(SRAA)结构的低密度奇偶校验码(LDPC)编码的硬件实现方法和资源占用情况。并在此基础上,提出了提高硬件存储资源利用率的单码率优化及三码率整合方案。
关键词：地面数字电视广播 低密度奇偶校验码 SRAA电路 单码率优化 三码率合一 
DVB-S2系统的LDPC编码并行实现方法研究
《电视技术》2007年第11期68-69,71,共3页马琦 陈曾平 
总装国防创新基金项目
提出了一种基于FPGA的DVB-S2系统中LDPC编码算法的硬件实现技术。试验表明,该算法支持编码规范中各种码率,具备高比特率输入信号的编码能力,且所需资源少,有较高的性价比。
关键词：下一代数字视频广播 低密度校验码 可编程门阵列 
用于DVB-S2的LDPC编码器设计被引量：7
《电视技术》2007年第B08期114-116,共3页武学彬 薛永林 
提出了一种利用FPGA上的RAM存储单元分组存储校验比特的方法,并据此设计了一种基于FPGA的LDPC编码器实现方案,同时分别采用并行和串行输入方式实现了该方案。结果表明,该方案达到了较高的编码速率,可满足高速数据应用要求。
关键词：DVB—S2标准 LDPC编码 FPGA芯片 
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