乔世杰

作品数：17被引量：43H指数：3
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供职机构：西安理工大学更多>>
发文主题：VLSIHDL零树编码VERILOG小波变换更多>>
发文领域：电子电信自动化与计算机技术更多>>
发文期刊：《微电子学》《计算机工程与应用》《电子学报》《现代电子技术》更多>>
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基于生物电容的视觉假体无线能量传输系统建模及效率优化被引量：2
《电子学报》2015年第1期104-110,共7页李学平 杨媛 高勇 乔世杰 
国家自然科学基金(No.61102017);陕西省教育厅专项科研计划(No.12JK0499);西安理工大学博士创新基金
为了解决视觉假体无线能量传输系统设计过程中参数选取的问题,本文进行了基于生物电容的视觉假体无线能量传输系统精确建模,并在该模型的基础上对次级线圈回路进行了优化,使能量传输效率较传统谐振耦合方法有明显提高.文中采用大、小两...
关键词：视觉假体 无线能量传输 生物电容 系统建模 效率优化 
一种改进的视频画质增强算法及VLSI设计被引量：2
《电子学报》2012年第8期1655-1658,共4页杨媛 高勇 房继军 乔世杰 韩超 
国家自然科学基金(No.61102017);陕西省自然科学基金(No.2009JQ8014)
由于视频图像多样化,目前尚无较好的增强方法适应视频画质增强.本文提出了一种改进的数字视频画质增强算法,并进行了硬件电路的设计.与传统的基于直方图均衡的方法不同,首先在YUV色彩空间对输入图像的信息进行判断分类和对比度调整,然...
关键词：色彩空间 画质增强 动态范围调整 
JPEG2000中位平面编码的VLSI结构设计被引量：1
《电子器件》2007年第6期2229-2232,共4页乔世杰 张益民 高勇 
位平面编码用于对量化的离散小波变换的码块数据进行编码.通过对位平面编码算法的分析和C语言验证,给出了位平面编码的四种基本编码操作和三个编码通道具体的VLSI结构实现.对位平面编码器的VLSI结构进行了仿真和综合,在图像验证系统上...
关键词：JPEG2000 位平面编码 VLSI VERILOG HDL C语言 
高性能IPv6转发引擎的FPGA实现
《计算机工程与应用》2006年第16期121-123,152,共4页乔世杰 韩毅 冯涛 彭海清 吴捷 
国家863高技术研究发展计划资助项目(编号:2002AA121012)
高速转发引擎是高性能IPv6路由器的关键技术,文章设计了一种IPv6高速转发引擎的硬件结构,编写了硬件结构的VerilogHDL模型,进行了仿真和逻辑综合,并成功用XILINX的FGPA对转发引擎进行了验证。测试结果表明,该文设计的转发引擎的结构正确...
关键词：IPV6 转发引擎 FPGA VERILOG HDL 
图像验证系统设计及FPGA实现被引量：2
《电子器件》2006年第3期825-828,共4页乔世杰 胡运平 高勇 
用于JPEG2000静止图像压缩编码FPGA实现的图像验证系统。整个系统平台是由一个并口CMOS电脑眼、两个FPGA芯片、UART接口以及外部缓存组成。为了对搭建的平台进行验证,将并口电脑眼采集的图像数据存储在外部SRAM中,然后通过UART接口传送...
关键词：图像验证系统 UART VERILOG HDL FPGA 
一种基于三维小波图像编码的远程监控系统
《西安理工大学学报》2006年第2期154-157,共4页乔世杰 智贵连 
实现了一种利用三维小波图像编码的远程监控系统。整个系统由本地监控端和远程主控端组成。本地监控端包括序列图像采集、三维小波图像编码以及数据流发送三部分。设计了整个监控系统的硬件结构,编写了相应的Verilog HDL设计描述代码,...
关键词：远程监控 三维小波变换 零树编码 FPGA VERILOG HDL 
一种三维小波序列图像编码算法及其FPGA实现被引量：1
《电子器件》2006年第2期420-423,共4页乔世杰 智贵连 
根据序列图像编码的特点,利用Harr小波变换、适合硬件实现的快速二维小波变换和快速零树编码算法,提出了一种适合硬件实现的三维小波变换序列图像编码算法。设计了该算法的VLSI结构,编写了相应的VerilogHDL模型,进行了仿真和逻辑综合,并...
关键词：三维小波变换 零树编码 VLSI Vefilog HDL 
显示器CRT呈色的转换模型的研究被引量：4
《西安理工大学学报》2006年第1期58-62,共5页张彤 乔世杰 
研究了标准空间图像值与CRT呈色空间相互转换的两个相互关联的模型,建立了转换的数学模型,并进行了误差分析与校正。在计算机上运用此模型进行了实际转换,得到了高精度的转换结果。
关键词：CRT 呈色 转换模型 
VLSI Implementation of a Wavelet Image Coder
《Journal of Semiconductors》2002年第7期695-700,共6页乔世杰 王国裕 
A modular architecture for two dimension (2 D) discrete wavelet transform (DWT) is designed.The image data can be wavelet transformed in real time,and the structure can be easily scaled up to higher levels of DWT.A f...
关键词：discrete wavelet transform zerotree image coding VLSI Verilog HDL CPLD 
小波图像编码的硬件实现(英文)
《现代电子技术》2002年第2期91-96,共6页乔世杰 王国裕 智贵连 
设计了二维离散小波变换和快速零树编码的硬件结构 ,实现了一小波图像编码系统。编写了各个模块的 Verilog HDL模型 ,并进行了仿真和逻辑综合。最后用 Altera公司的 CPL D对整个编码系统进行了验证。结果表明 ,设计的硬件结构是正确的 ...
关键词：离散小波变换 零树编码 VERILOGHDL VLSI 图像编码 硬件实现 
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