异或门

作品数:81被引量:92H指数:5
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一种适用于物联网设备的基于异或门的Pico物理不可克隆函数
《密码学报(中英文)》2024年第2期403-415,共13页王骏君 黄钊 刘锦辉 樊璐 万波 王泉 
国家自然科学基金(61972302);陕西省自然科学基础研究计划(2022JQ-680);中央高校基本科研基金(XJS220306)。
针对可重构Pico-PUF对机器学习建模攻击抵抗能力较弱,本文对RPPUF进行了改进,提出了一种基于异或门的抗ML攻击的可重配置Pico-PUF,即XORPPUF.通过将可配置逻辑中的每个非门替换为异或门,并将PUF的输出进行混淆处理,提高了PUF抗ML攻击能...
关键词:物理不可克隆函数 异或门 物联网设备 硬件安全 抗机器学习攻击 FPGA 
闪烁的神经网络
《中国信息技术教育》2024年第7期23-27,共5页陈凯 
本文给出了一种基于数字逻辑电路的模拟神经元行为以及构建简单神经网络的方法,主要围绕非线性的异或运算的实现,完整呈现了基于随机发生器、计数器、数字比较器和逻辑门等数字逻辑元件模拟神经元行为和构建神经网络的过程,并讨论了其...
关键词:感知机 神经网络 异或门 数字逻辑电路 
基于量子元胞自动机的n位全加器设计
《电子学报》2024年第2期626-632,共7页张辉 解光军 张永强 
中央高校基本科研业务费专项资金资助(No.JZ2020HGTA0085);青年教师科研创新启动专项(No.JZ2020HGQA0162)。
量子元胞自动机(Quantum-dot Cellular Automata,QCA)以其功耗低、纳米级设计、运算速度高等特点被认为是一门新兴技术,在不久的将来有望取代CMOS工艺,用于量子计算机的电路设计.近年来,在QCA电路中有很多使用三输入择多门(M3)和三输入...
关键词:量子元胞自动机 全加器 三输入择多门 三输入异或门 时钟延迟 
基于异或门的动态可重构的ROPUF设计与验证
《集成电路应用》2024年第1期8-10,共3页赵达 张竣昊 魏江杰 张锐 骆思成 
阐述物理不可克隆函数(Physical Unclonable Function,PUF)技术的新结构、响应纠错、安全性及其应用,这是可重构物理不可克隆技术电路结构的研究,属于PUF新结构研究的一个分支。针对已提出的环形振荡器物理不可克隆函数(Ring Oscillator...
关键词:物理不可克隆函数 环形振荡器 可重构 异或门 
基于电流型CMOS的n变量函数分解新算法及电路设计
《杭州师范大学学报(自然科学版)》2023年第6期649-657,共9页姚茂群 邱思越 孙曦 李聪辉 张慧熙 
国家自然科学基金项目(61771179)。
电流型电路具有功耗低、速度快的特点,是当今集成电路研究的一个热点.文章基于阈算术代数系统,改进了非相交分解算法;设计了电流型互补金属氧化物半导体(complementary metal oxide semiconductor, CMOS)的异或门电路,并利用改进后的新...
关键词:电流型 CMOS 异或门 非相交分解算法 阈算术代数系统 
利用细粒度采样的低开销双输出异或门真随机数发生器研究
《电子与信息学报》2023年第9期3295-3301,共7页姚亮 黄正峰 梁华国 鲁迎春 
国家自然科学基金面上项目(62174048,62274052),国家自然科学基金重大科研仪器研制项目(62027815),国家自然科学基金重点合作项目(61834006);中央高校基本科研业务费专项资金资助(JZ2022HGQA0233)。
真随机数生成器(TRNG)是安全应用中的关键构建模块,能够为数据加密、随机数和初始化向量提供高质量的随机位。环形振荡器(RO)TRNG是一种广泛的应用设计,以支持各种与安全相关的应用。但是,在FPGA中实现RO TRNG时通常会产生很高的硬件开...
关键词:真随机数发生器 细粒度采样 低面积开销 
科幻小说——信息技术课堂的宝藏
《中国信息技术教育》2023年第9期20-20,共1页魏宁 
如果你读过刘慈欣的《三体》,一定会记得里面的名场面“人列计算机”--冯·诺伊曼说服秦始皇调动三千万人组成的“一台”巨大计算机。书中冯·诺伊曼用3名士兵举黑白两色旗的方式为秦始皇演示了如何构建计算机最基本的运算部件与门、或...
关键词:信息技术课堂 科幻小说 信息技术教学 三态门 与非门 或非门 异或门 《三体》 
基于忆阻器的组合逻辑电路设计被引量:1
《半导体技术》2022年第8期649-659,共11页姬超 李拓 邹晓峰 张璐 
山东省重大科技创新项目(2019TSLH0201)。
基于忆阻器的数字逻辑电路为探索先进的计算体系结构开辟了新的途径。在多种基于忆阻器的逻辑设计方法中,忆阻器比例逻辑(MRL)可以与传统CMOS工艺兼容制备出基本的门电路元件。简化了CMOS结构,仅单独使用NMOS管与忆阻器级联可以实现各...
关键词:忆阻器 组合逻辑 LTspice仿真 异或门 全加器 
基于差分编码技术的12.5Gbit/s高速SerDes发射机被引量:5
《微电子学》2021年第1期85-90,共6页彭嘉豪 李儒章 付东兵 丁一 杨虹 
模拟集成电路国家重点实验室基金资助项目(614280205020417)。
研究并设计了一种基于差分编码技术的12.5 Gbit/s高速SerDes发射机。该电路由并串转换模块、去加重控制模块和驱动模块组成。驱动模块采用电流模逻辑异或门结构,动态负载的加入可以在降低功耗的同时实现与传输线的阻抗匹配。首次提出在...
关键词:差分编码 高速SerDes 电流模逻辑异或门 动态负载 
异或门自治布尔网络及物理随机数发生器被引量:3
《深圳大学学报(理工版)》2021年第1期103-109,共7页杜海鋆 张建国 刘海芳 龚利爽 刘锋 王云才 
国家自然科学基金资助项目(61671316);山西省自然科学基金资助项目(201801D121145)。
自治布尔网络作为可调控的非线性系统,易于产生混沌信号.利用二输入异或门的非线性特性实现一种可产生高熵值混沌的18节点自治布尔网络电路.通过引入滤波系数,建立该电路的改进数学模型.通过数值仿真和电路对比实验研究滤波系数和时延...
关键词:物理电子学 非线性系统 布尔网络 混沌电路 物理随机数 保密通信 
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