数字时钟

作品数：159被引量：160H指数：6
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简易数字时钟设计与制作
《电子制作》2024年第15期91-94,共4页束仁义 王宜结 王千春 王留留 
安徽省高等学校质量工程教学研究项目(项目编号:2022jyxm1433,2021jyxm1384);淮南师范学院质量工程教学研究项目(项目编号:2021hsjyxm03);淮南师范学院电子信息工程专业教学创新团队(项目编号:2023hsjxtd01)。
为培养电子信息类专业学生电子设计与动手操作能力,切实提高工程实践水平,设计了一套完整的数字时钟系统制作过程,从系统论证到原理图绘制,从代码编写到软件仿真,从PCB制板到元器件焊接,从下载调试到功能实现。通过项目全过程实施,使学...
关键词：电子设计 AT89C2051 数字时钟 数码管 
基于职业院校教学能力比赛的单片机技术课程教学设计与实施——以“LED数字时钟安装与编程控制”作品为例
《广东教育（职教）》2024年第7期124-126,共3页洪石钦 颜光 
作为2023年广东省职业院校技能大赛教学能力比赛一等奖作品,学校“LED数字时钟安装与编程控制”以LED数字时钟为载体,学生分步学习安装与编程控制相关知识,逐步完成LED数字时钟整体功能。该项目以培养懂原理、会编程、有科技梦想的时代...
关键词：理实一体化教学 职业院校技能大赛 智慧教育 职业院校教学 数字时钟 编程控制 以学生为中心 整体功能 
面向数字时钟调相的高精度低跃变控制码设计
《信息技术》2024年第4期131-136,共6页吴雪莹 管武 邱昕 
国家重点研发计划(2018YFB2201502)。
面向数字时钟调相系统,提出了一种相位插值控制码匹配方法,减少了相邻相位之间控制码变化的位数,减小了相位误差和幅度跃变。通过迭代的思想,同时平衡控制码跳变所带来的误差与相位调整之间的转换关系,并行考虑控制码对输出信号幅度的影...
关键词：数字时钟调相 相位插值 控制码 高精度 低跃变 
自制最好的石英钟
《科技纵览》2024年第2期18-20,共3页Gavin Watkins 
高级计时技术进入家庭。我一直对精准计时技术很感兴趣。现今,我们主要依赖互联网或者来自GPS卫星、广播电台的无线电波提供的计时。但我想要一个不依赖外界也可良好运行的计时时钟,而且一定要比一般的数字时钟或微控制器中使用的石英...
关键词：石英晶体振荡器 无线电波 时间偏差 数字时钟 微控制器 广播电台 互联网 GPS卫星 
基于ESP8266的复古辉光时钟的设计与制作
《电子制作》2023年第1期89-92,共4页邱桦霖 
时钟一直是我们生活中不能缺少的物品,现代的数字时钟主要采用了LED数码管进行显示。但还有一种显示方式是采用辉光管。辉光管点亮时十分美观,具有个I人收藏和观赏价值。本次设计把电子时钟的显示改为辉光管。时钟采用ESP8266为主控,DS1...
关键词：ESP8266 数字时钟 辉光管 
创新众筹项目大搜罗
《无线电》2022年第10期5-5,共1页金今 
集成时钟功能的移动电源Shargeek的工程师和设计师在过去几年创建了一系列独特的电池组,如今他们推出了一款集成倒计时功能的移动电源Capsule Gravity。Capsule Gravity是一个时间管理器,可以当作多用途数字时钟和3合1计时器使用。就像...
关键词：电池容量 移动电源 计时器 重力传感器 智能设备 充电速度 电池组 数字时钟 
智能小闹钟
《无线电》2022年第10期81-84,共4页刘育红 
“智能小闹钟”是一个具有闹铃功能的数字时钟,其智能体现在通过上下翻转即可实现闹铃的开启与关闭,屏幕上显示的数字也会随之翻转。通过该项目,制作者可以掌握OLED显示屏、DS1307时钟模块和数字倾角传感器的使用方法。
关键词：倾角传感器 时钟模块 数字时钟 DS1307 翻转 闹钟 制作者 智能 
基于M-LVDS总线的机载通信系统数字时钟设计与实现被引量：1
《电子技术（上海）》2022年第6期1-3,共3页向习莲 
阐述对机载通信系统中各类数据链时钟精度的要求,系统100MHz时钟精度需达到10-8量级。机载通信系统采用综合机架,机箱背板基材选用、信号线层叠设计、信号线短桩设计等因素均会影响100MHz的时钟的传输精度和抖动。基于M-LVDS总线传输技...
关键词：通信系统 数据时钟 高精度 低抖动 层叠设计 M-LVDS总线 
我的数字时钟
《中学数学月刊》2022年第4期73-74,共2页蔡雨菲 刘银露(指导) 
创意时钟是常见的物品,文章分析了部分时钟设计中的差错,并自定义规则给出了有数学韵味的数字时钟设计方案.
关键词：数字时钟 数学味 设计方案 
基于FPGA的数字时钟设计
《沈阳建筑大学学报（自然科学版）》2022年第2期364-371,共8页黄明霞 许泽恩 张海强 包龙生 
国家自然科学基金面上项目(2018YFC0809606);辽宁省自然科学基金项目(2020-KF-12-08)。
目的 设计一个具有计数、调时功能的数字时钟,以二十四小时为一个周期循环计数。方法 用Verilog HDL硬件描述语言,在Quartus Ⅱ开发环境下采用自顶向下的方法设计数字时钟;设计主要包括分频模块、计数校时模块和译码显示模块三部分;分...
关键词：数字时钟 Veriolg HDL FPGA QuartusⅡ 
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