静态功耗

作品数：145被引量：207H指数：6
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小尺寸WLCSP封装Mach×02PLD
《今日电子》2011年第10期63-63,共1页
MaCh×O2PLD系列推出2．5mm×2．5mm25球型晶圆级芯片尺寸封装（WLCSP）产品，与前代产品相比，增加了3倍的逻辑密度，提高了10倍的嵌入式存储器，减少了100倍的静态功耗。这些器件结合了超小封装尺寸、超低功耗和丰富功能等特点，可以...
关键词：CSP封装 MACH 小尺寸 芯片尺寸封装 嵌入式存储器 MACH 逻辑密度 静态功耗 
具有安全特性的低功耗FPGA
《今日电子》2009年第8期72-72,共1页
AlteraCycloneⅢLSFPGA在单位面积电路板上具有密度最大的逻辑、存储器和DSP资源。该器件功耗极低，200K逻辑单元（LE）的静态功耗小于0．25W，适合对功耗和电路板面积非常敏感的应用。
关键词：低功耗 FPGA 安全特性 电路板面积 逻辑单元 单位面积 静态功耗 DSP 
微功耗＋3．3V．双SCART方案
《今日电子》2009年第7期61-61,共1页
MAX9598的音频和视频电路工作在＋3．3V电源，仅在处理低速切换信号时需要＋12V电源。内部的电荷泵将＋3．3V电源反相，从而产生-3．3V电源，可为2．0VRMS音频信号提供足够的电压摆幅。其静态功耗仅为70mW。MAX9598还集成了输入视频信...
关键词：微功耗 音频信号 视频电路 输入信号 电压摆幅 静态功耗 检测电路 视频信号 
40nm FPGA的功耗管理和优势被引量：1
《今日电子》2009年第2期50-53,共4页Sevi Verma 
随着工艺尺寸的减小，数字逻辑电路的漏电流成为当前FPGA面临的主要挑战。静态功耗增大的主要原因是各种漏电流源的增加。图1所示为随着更小逻辑门长度的技术实现，这些漏电流源是怎样随之增加的。此外，如果不采取专门的功耗措施，较...
关键词：功耗管理 FPGA 数字逻辑电路 优势 工艺尺寸 静态功耗 技术实现 动态功耗 
基于ARM7的入门级开发工具包
《今日电子》2008年第10期127-127,共1页
AT91CAP7A－STK入门级开发工具包，是专为评测其基于ARM7处理器的CAP可定制微控制器（MCU）系列而设的入门级工具。CAP7可定制MCU可让设计人员从“ARM7加FPGA”设计转移到低一次性研发费用（NRE）的单芯片解决方案，单位器件的成本约降...
关键词：ARM7处理器 开发工具包 入门级 设计人员 静态功耗 微控制器 FPGA 可定制 
能在便携应用中实现“零功耗”的CPLD器件 减小了功耗、体积和成本
《今日电子》2008年第1期103-103,共1页
零功耗MAXIIZCPLD是专门针对解决便携式应用市场的功耗、封装和价格限制而设计开发的。其静态功耗仅为29μA，使手持式设备和其他便携式应用能够充分发挥CPLD的诸多优势——包括灵活性、产品快速面市以及电路板级集成等。
关键词：CPLD器件 便携式应用 零功耗 成本 体积 手持式设备 静态功耗 电路板 
低功耗的IGLOO系列FPGA
《今日电子》2007年第10期101-101,共1页
IGLOO系列FPGA的静态功耗仅为5μW。在IGLOO FPGA中，Cortex—M1核在静态模式下仅消耗24μA，在睡眠模式下更低至3μA。IGLOO采用创新的Flash Freeze模式，使到器件可在保存SRAM和寄存器数据的同时简便地进入或退出超低功耗模式，并将...
关键词：低功耗模式 FPGA 静态功耗 Flash 睡眠模式 SRAM 静态电流 寄存器 
适用于便携式产品的低功耗IGLOO系列FPGA
《今日电子》2006年第9期99-99,共1页
低功耗的IGLOO系列FPGA在Flash工艺的ProASIC3FPGA基础上，采用了多种功率优化技术和130nm工艺，使静态功耗降至5uW，可延长便携式应用的电池寿命达5倍，满足了便携式应用对功耗的严苛要求。IGLOO系列FPGA支持1．2V电压，具有多种功率...
关键词：低功耗模式 FPGA 便携式产品 优化技术 消耗功率 静态功耗 
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