SERDES

作品数：223被引量：161H指数：6
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一种用于高性能FPGA的多功能I/O电路
《半导体技术》2025年第3期265-272,共8页罗旸 刘波 曹正州 谢达 张艳飞 单悦尔 
国家自然科学基金面上项目(62174150);江苏省自然科学基金面上项目(BK20211040,BK20211041)。
为了满足等效系统门数为亿门级现场可编程门阵列(FPGA)的高速率、多功能数据传输需求,设计了一种用于高性能FPGA的多功能输入输出(I/O)电路,工作电压为0.95 V,单个I/O电路的最高数据传输速率为2 Gbit/s。通过在输入逻辑电路中设计同一...
关键词：现场可编程门阵列(FPGA) 输入输出(I/O)电路 多电平标准 双倍数据速率(DDR) 串并转换器(SerDes) 
一种抗电离干扰的高速串行驱动器被引量：2
《半导体技术》2019年第8期600-605,共6页邹家轩 于宗光 曹晓斌 袁霄 
国家“十三五”微电子预研项目(31513010412)
针对工业界高速串行接口(SerDes)发射级的驱动器在电离干扰条件下受到单粒子效应(SEE)干扰导致传输出错的问题,分析了经典高速SerDes驱动器结构受SEE干扰的机理,提出了一种采用密勒补偿的互补电流源全差分驱动电路结构,能够显著抑制单...
关键词：抗电离辐射 单粒子效应(SEE) 高速串行接口(SerDes) 驱动器 绝缘体上硅(SOI) 
用于12.5Gbit/s SerDes系统锁相环倍频器设计
《半导体技术》2012年第12期918-922,共5页茅俊伟 冯军 窦建华 章丽 李伟 
采用0.18μm CMOS工艺设计了一款6.25 GHz锁相环倍频器,该倍频器适用于12.5 Gbit/s半速率复接的串行器/解串器(SerDes)发射系统。该锁相环倍频器不仅为SerDes发射系统提供6.25 GHz的时钟,也为系统提供1.25 GHz占空比1∶4的时钟。设计中...
关键词：串行器 解串器(SerDes) 锁相环倍频器 分频器 SCFL触发器 真单相时钟(TSPC) 
飞兆半导体推出μSerDes^TM器件
《半导体技术》2005年第5期80-81,共2页
飞兆半导体公司宣布推出名为μSerDes^TM(micro—SerDes)的创新超紧凑型串化器／解串器系列器件FINl2和FIN24，适于解决便携产品和消费电子应用中由于产品功能聚合而引致复杂性不断增加的设计难题。这些uSerDes器件能将传统的多数据并...
关键词：推出 SerDes器件 飞兆半导体公司 产品功能 电子应用 便携产品 串行传输 并行传输 抑制技术 串行链路 管理系统 电磁兼容 解串器 串化器 紧凑型 复杂性 多数据 EMI 创新 缩减 
产品博览
《半导体技术》2004年第3期90-90,共1页
关键词：FPGA StratixⅡ SERDES 光收发模块 TDM 
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