UART

作品数：681被引量：1278H指数：15
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一种LZ4压缩算法的FPGA硬件加速设计方法
《信息技术与信息化》2025年第2期187-191,共5页王佳伟 盛庆华 秦宽 陈凯 单铮 黄小芳 
国家级大学生创新创业训练计划支持(202310336045)。
随着信息技术和互联网的快速发展,数据量呈现爆炸式增长,对高效无损压缩算法的需求日益迫切。为解决传统软件压缩算法在存储系统中资源占用过多和压缩速度较慢的问题,提出了一种基于FPGA的LZ4无损压缩算法硬件加速系统。该系统包括UART...
关键词：LZ4 无损压缩算法 XXH32 UART FPGA 
基于PLD的UART接口芯片电路设计被引量：3
《信息技术与信息化》2021年第10期174-176,共3页李雪伟 宗荣芳 刘浩 罗燕洋 
随着微电子技术的快速发展,电子系统朝着小型化、集成化、低功耗等方向发展,而可编程逻辑器件(programmable logic device,PLD)器件具有I/O口多、运算速度快、可移植性强等特点,所以在设计中利用PLD器件来进行UART接口芯片的电路设计与...
关键词：UART 现场可编程门阵列 硬件描述语言 
基于FPGA的宽波特率误差容忍范围的UART设计被引量：5
《信息技术与信息化》2021年第9期169-171,176,共4页丰淑凤 朱晓莹 王旭 
山东管理学院科研起航计划,编号:0121810107。
在进行高速数据传输时,串行通信会存在通讯双方波特率时钟相对误差以及受到环境因素的干扰,导致通信质量可靠性的下降。针对这一问题,对串行通信波特率误差的容忍范围进行了研究,并基于FPGA设计了一种基于波特率自适应的动态采样接收方...
关键词：串行通信 FPGA 波特率容忍范围 动态采样 
基于FPGA的UART抗干扰接收装置设计与实现被引量：5
《信息技术与信息化》2020年第8期122-124,共3页张名淑 张雅迪 王旭 陈飞 钱祥利 
山东管理学院博士启动基金(SDMU201903)。
传统的UART串行通信在噪音干扰比较大的环境中会出现通信失误,导致通信不稳定。为了提高UART串行通信的抗干扰能力,本文基于Xilinx FPGA与Verilog硬件描述语言设计了一种UART抗干扰接收装置,主要包括16倍过采样波特率时钟、九选五表决...
关键词：FPGA UART 表决器 波特率产生器 
基于cc3200的无线传输系统的设计被引量：3
《信息技术与信息化》2018年第7期38-40,共3页王博 邱达 张远念 吕亮 秦浩 何为 
湖北民族学院大学生创新创业训练计划资助项目(2017CX122)
本项目完成了cc3200间数据的无线传输。通过在CCS中的编译调试,并且部署TI-RTOS嵌入式操作系统,可以实现基于UART与TCP套接字实现的的接入点与站点间的双向数据传输。cc3200作为本项目的核心器件,其具有高度集成,安全可靠,操作便捷等特...
关键词：WIFI cc3200 TI-RTOS UART TCP 套接字 
一种基于ARM7的IO扩展系统的设计被引量：1
《信息技术与信息化》2009年第5期49-50,共2页于治楼 乔国凯 
本文介绍了一种基于ARM7处理器实现多IO扩展的系统设计。该系统具有控制灵活、接口简单、占用系统资源少等优点,可广泛应用于工业控制、家庭安防、以及GPS卫星定位导航等领域,解决了主机串行通信接口不足的问题。
关键词：ARM CPLD IO UART 
基于FPGA/CPLD的通用异步通信接口UART的设计被引量：13
《信息技术与信息化》2006年第1期86-88,共3页姜宁 范多旺 
UART(通用异步接收发送设备)是一种短距离串行传输接口。在数字通信和控制系统中得到广泛应用。FPGA/CPLD是大规模集成电路技术发展的产物,是一种半定制的集成电路。结合计算机软件技术(EDA技术)可以快速、方便地构建数字系统。本文介...
关键词：UART VHDL FPGA/CPLD 仿真 
基于VHDL设计有限状态机FSM的方法被引量：4
《信息技术与信息化》2004年第4期29-31,共3页井新宇 
介绍了有限状态机的特点和设计方法 ,以设计UART为例 ,应用EDA技术 ,基于VHDL语言 ,以FPGA
关键词：VHDL 有限状态机 FSM UART EDA 
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