方卓红

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发文主题：集成电路设计仿真移动电脑AES加密VERILOG硬件描述语言更多>>
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寄存器堆设计方法研究
《科技信息》2010年第33期I0033-I0033,I0068,共2页方卓红 
青岛市科技计划项目<可移动高性能电脑加密机的研究与设计>提供支持
本文利用Verilog硬件描述语言设计了一个寄存器堆,并对其进行了仿真测试。该寄存器堆包含32个32位的寄存器,具有2个读端口和1个写端口,仿真结果表明该寄存器堆的功能是正确的。
关键词：集成电路设计 寄存器堆 VERILOG硬件描述语言 仿真 
算术逻辑运算单元的设计与仿真
《科技信息》2009年第33期I0059-I0059,I0023,共2页方卓红 曲英杰 
本文利用Verilog硬件描述语言并采用结构化建模方法设计了一个算术逻辑运算单元,并对其进行了仿真测试。该算术逻辑运算单元的字长为32位,能够实现加法、减法、逻辑与、逻辑或四种运算,并产生相关的标志位。仿真结果表明该算术逻辑运算...
关键词：集成电路设计 算术逻辑运算单元 VERILOG硬件描述语言 结构化建模 仿真 
多周期处理机控制模块的设计与仿真
《科技信息》2008年第36期17-18,共2页曲英杰 方卓红 
青岛市科技计划项目-可移动高性能电脑加密机的研究与设计提供支持。
本文针对一个可广泛应用于嵌入式系统的多周期处理机,提出了其控制模块的设计方法,用Verilog硬件描述语言设计实现了该控制模块,并通过仿真验证了其功能是正确的。
关键词：多周期处理机 控制模块 VERILOG语言 仿真 
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