硬件实现

作品数:1524被引量:3089H指数:17
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一种改进的实时半全局立体匹配算法及硬件实现被引量:8
《计算机工程》2021年第9期162-170,共9页赵晨园 李文新 张庆熙 
国家自然科学基金(61125101);中国载人航天工程重大专项(RWZY640601)。
在基于现场可编程门阵列的实时立体匹配系统中,Census变换算法针对特定区域的误匹配率较高。为提高匹配精度,提出一种具有高并行性流水线结构的实时半全局立体匹配算法并进行硬件实现。将改进的Tanimoto距离和带权重4方向的梯度绝对值...
关键词:现场可编程门阵列 立体匹配 Census变换 Tanimoto距离 实时半全局匹配 
基于FPGA集群的脉冲神经网络仿真器设计被引量:4
《计算机工程》2020年第10期201-209,共9页李康 张鲁飞 张新伟 郁龚健 刘家航 吴东 柴志雷 
国家自然科学基金(61972180);数学工程与先进计算国家重点实验室开放基金(2018A04)。
针对类脑计算系统中NEST脉冲神经网络仿真器运行速度慢和功耗高的问题,设计一种基于现场可编程逻辑门阵列(FPGA)集群的NEST脉冲神经网络仿真器。在改进NEST仿真器结构的基础上,提出漏电流整合放电神经元计算模块的流水线并行架构,实现...
关键词:类脑计算系统 脉冲神经网络仿真器 现场可编程逻辑门阵列集群 硬件实现 皮质层视觉仿真模型 
针对分组密码的攻击方法研究被引量:2
《计算机工程》2020年第1期102-107,113,共7页朱文锋 王琴 郭筝 刘军荣 
国家自然科学基金“针对S芯片验证模块引脚信息的自动分析技术”(U1536103);上海市闵行区中小企业技术创新计划“基于区块链技术的金融业务平台”(2018MH110)
为提升旁路攻击对分组密码算法硬件实现电路的攻击效果,增大正确密钥与错误密钥间的区分度,提出一种针对分组密码的旁路攻击方法。结合差分功耗分析(DPA)攻击和零值攻击的特点,通过分类来利用尽可能多的功耗分量,以攻击出全部密钥。在F...
关键词:旁路攻击方法 硬件实现 分组密码算法 组合逻辑功耗 信噪比 
一种面向RFID的超轻量级流密码算法
《计算机工程》2019年第10期144-149,共6页夏文涛 潘森杉 王良民 
国家自然科学基金青年基金(61702230)
针对无线射频识别(RFID)系统安全性较低的问题,提出一种适用于RFID标签的超轻量级流密码算法Willow。根据正差集性质选取函数抽头,以增加猜测确定攻击的复杂度。采用动态初始化方式并使用位数较小的计数器进行密钥索引和初始化,从而降...
关键词:超轻量级流密码 无线射频识别 动态初始化 硬件实现 时间存储数据折中攻击 
基于FPGA的快速视频图像去雾算法及硬件实现被引量:4
《计算机工程》2016年第6期310-315,共6页周晓波 刘桑 
中央高校基本科研业务费专项基金资助项目(2013JBM010)
针对雾天采集图像的退化问题,基于暗通道先验理论,提出一种能够处理视频图像的快速去雾算法。根据视频图像在实时处理系统中的应用,基于现场可编程门阵列(FPGA)硬件平台的特性,对算法进行硬件实现。经过Matlab环境的仿真验证,并在自行...
关键词:暗通道先验 实时视频图像 快速去雾 现场可编程门阵列 硬件系统 
基于FPGA的祖冲之算法硬件实现被引量:3
《计算机工程》2014年第8期268-272,共5页郭泓键 董秀则 高献伟 
北京市教育教号改革基金资助项目(121);北京电子科技学院教研基金资助项目(JY201218)
为在现场可编程门阵列(FPGA)平台上更高效地实现祖冲之算法,提出一种新的硬件实现方法。利用祖冲之算法的迭代特性、并行特性以及模加的性质,减少加法器的使用数量,包括使用资源占用少、延时少的简单加法器替代资源占用多、延时长的进...
关键词:现场可编程门阵列 祖冲之算法 硬件实现 进位保留加法器 mod(231-1)加法器 
基于流水线技术的并行模幂算法硬件实现被引量:2
《计算机工程》2013年第7期16-20,25,共6页黄世伟 王云峰 
针对R-L模幂算法并行硬件实现成本高的问题,提出一种流水线形式的模幂运算结构。采用流水线技术对模幂算法中Montgomery模乘运算进行硬件设计,并由此构建模幂运算结构,实现并行模幂运算,降低硬件成本。同时对模幂算法中预处理和后处理...
关键词:蒙哥马利算法 模乘 模幂 RSA公钥密码体制 流水线技术 现场可编程门阵列原型 
基于Hash函数的MD5算法研究和硬件实现被引量:5
《计算机工程》2013年第3期137-141,共5页洪琪 周琴琴 王永亮 陈高峰 
国家"863"计划基金资助项目(2009AA012201)
在传统MD5算法中,最影响执行速度的步骤是对关键路径变量B的求取。为提高算法的执行速度,对关键路径进行优化,将加法运算分成两步,由此缩短B的求取时间。用Verilog语言描述改进算法的硬件结构,并对其进行综合。实验结果表明,该电路的面...
关键词:MD5算法 VERILOG硬件描述语言 HASH函数 循环计算 关键路径 工作频率 
一种适合于硬件实现的数字预失真算法
《计算机工程》2012年第7期230-232,共3页董传盛 曾真 谈熙 闵昊 
国家"863"计划基金资助项目(2009AA011605);"核高基"重大专项(2009ZX01031-003-002);国家自然科学基金资助项目(61076028)
传统的数字基带预失真算法较复杂不易实现。为此,设计一种适合于硬件实现的数字预失真算法。考虑对模拟射频部分引入的环路延迟和相位偏转的补偿,采用2块大小为32×16的查找表作为预失真模块,存储针对不同输入幅度信号的调整系数,以预...
关键词:功率放大器 预失真 查找表 硬件实现 环路延迟 相位粗旋转 
WCET可预测的Java指令集硬件实现被引量:1
《计算机工程》2012年第1期14-18,共5页杨帆 高振华 柴志雷 
国家自然科学基金资助项目"高可靠实时系统的计算平台(SOPC)研究"(60703106)
为能以硬件方式直接执行CISC结构的Java字节码,设计并实现适用于32位嵌入式实时Java平台的JPOR-32指令集。分析Java虚拟机规范中各Java字节码的功能和实现原理,设定执行每条指令时信号和数据在Java处理器数据通路上的变化,采用微指令方...
关键词:实时Java平台 JPOR-32指令集 JAVA处理器 微指令 最坏情况执行时间 
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