帧内预测

作品数：543被引量：782H指数：13
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3D-HEVC中深度图帧内预测模式判决过程的改进被引量：1
《电子技术应用》2016年第10期116-119,共4页雷海卫 刘文怡 王安红 
国家基金委重大国际(地区)合作研究项目(61210006);国家自然科学基金(6127262);2015年山西省高等学校科技创新项目(20151101)
深度图建模模式的使用可以有效地降低编码的深度图内部边界处的伪影效应,从而改善深度图的编码质量,但同时也极大地增加了编码的计算复杂度。为了降低由此而带来的计算复杂度,对深度图帧内预测的模式判决过程和现有的快速模式判决方案...
关键词：3D-HEVC 深度图编码 帧内预测 模式判决 
基于FPGA的AVS帧内预测电路设计被引量：2
《电子技术应用》2013年第8期50-53,共4页李文军 王祖强 徐辉 张贞雷 
提出了一种AVS高清视频编码器帧内预测模块硬件结构。通过对AVS帧内预测各个预测模式的分析,设计了帧内预测编码流水线结构和模式预测运算单元电路。根据各预测模式的编码运算关系,合理安排流水线结构,采用8 bit数据并行流水处理,实现...
关键词：AVS 帧内预测 硬件架构 流水线 并行处理 
H.264视频解码器中帧内预测模块的硬件设计被引量：1
《电子技术应用》2011年第10期53-55,59,共4页宋健 王祖强 秦盼 
提出一种能实时处理的H.264/AVC帧内预测硬件结构。通过对H.264/AVC各个预测模式的分析,设计了一个通用运算单元,提高了硬件资源的可重用性。采用4个并行运算单元计算预测值,对运算比较复杂的plane模式预处理,并设计模式预测器,加快了...
关键词：H.264 解码器 帧内预测 硬件 
AVS视频解码中帧内预测模块的硬件化设计及SoPC验证被引量：2
《电子技术应用》2009年第10期18-21,共4页刘家良 任怀鲁 陈新华 
青岛市科技计划项目(07-2-3-1-jch)
论述了适用于AVS解码器的帧内预测模块硬件化设计,提出了一种关键路径更短、占用资源更少的可重构运算单元(PE),利于流水线设计,可以提高运行频率。在参考样本管理方案中采用了一种环形RAM预加载方案,可以有效地提高预测速度。通过在Cyc...
关键词：帧内预测 AVS视频编码标准 硬件加速 SOPC 
H.264视频解码IP核的设计与实现被引量：2
《电子技术应用》2009年第10期25-27,29,共4页梁盼 陶宝泉 付永庆 
设计了一种基于FPGA高效并行结构的H.264视频解码IP核,提出了优化遍历查表的CAVLC熵解码设计方案,并详细介绍了全流水线并行运算结构的反量化反DCT变换模块和帧内预测模块的硬件实现。设计通过Altera公司Stratix Ⅱ系列的EP2S60F672C5E...
关键词：H.264 SOPC 帧内预测 CAVLC DCT 
AVS解码器中帧内预测模块的设计与实现被引量：1
《电子技术应用》2009年第2期64-67,共4页袁鲲 张卫宁 李晓燕 赵建全 
阐述了AVS视频解码器的总体框架,详细分析了帧内预测的原理与算法,提出了一种可行的帧内预测解码器的硬件设计,给出了每一模块的功能和结构的详细介绍,并建立了一种高效的存储机制。通过FPGA平台的验证,表明本设计完全满足AVS标清视频...
关键词：音视频编码标准 解码器 帧内预测 现场可编程门阵列 
H.264及AVS双模视频解码器中帧内预测的硬件设计与实现被引量：1
《电子技术应用》2007年第9期41-44,共4页姜弢 周佩海 MIN Bahadur K.C 
根据H.264/AVC及AVS的特点,设计出一种适合于帧内预测解码的硬件实现方式,并根据H.264和AVS帧内预测运算上的相似性提出了基于可重构的并行结构,有利于提高解码速度,并将该结构配合其他设计好的解码器模块,在FPGA上实现了高准清晰度的H....
关键词：H.264 AVS 帧内预测 视频解码系统 
针对硬件实现的H.264视频编码算法改进被引量：2
《电子技术应用》2004年第7期48-50,共3页周怡 吴昊 方向忠 
从硬件实现的角度分析了H.264算法,重点研究了占用最多运算时间的预测部分的优化,给出了对帧内预测、哈达马变换以及运动估计算法的改进,通过简化运算复杂、效率不高的模块以及减少模块间数据相关性等,对硬件进行优化。通过对各种测试...
关键词：H.264 视频编码 帧内预测 运动估计 运动预测因子 
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