时钟电路

作品数：217被引量：240H指数：7
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一种可降低开关电源电磁干扰的扩频时钟电路
《固体电子学研究与进展》2024年第3期239-244,共6页钟超超 宋奎鑫 孔瀛 康磊 梁庭 
介绍了一种基于0.18μm BCD工艺实现的可用于降低开关电源转换器电磁干扰(Electromagnetic inter⁃ference,EMI)的扩频时钟电路,电路中的双相张弛振荡器可在1.8~4.0 MHz工作,采用了一个三输入比较器配合时序电路实现了振荡器的正常启动...
关键词：扩频 低电磁干扰 伪随机 张弛振荡器 
面向电荷泵的占空比可调四相时钟发生电路
《微电子学》2023年第4期629-635,共7页史世昕 虞致国 孙一 王雨桐 顾晓峰 
江苏省重点研发计划产业前瞻与关键核心技术项目(BE2023019-3);长三角科技创新共同体联合攻关项目(2022CSJGG0402)
针对传统四相时钟发生电路产生的时钟波形信号易发生交叠、驱动电荷泵易发生漏电等问题,提出了一种占空比可调四相时钟发生电路。电路在每两相可能出现交叠的时钟信号之间都增加了延时单元模块,通过控制延时时间对输出时钟信号的占空比...
关键词：电荷泵 四相时钟电路 延时单元 
一种低功耗实时时钟RTC设计
《电子技术与软件工程》2022年第12期122-125,共4页戴澜 周子坤 
本文设计了一款小面积低功耗实时时钟RTC。通过使用Link-joint异步自时钟电路结构和设计方法,有效降低了实时时钟RTC的电路面积和计时过程中的动态功耗。在异步设计平台和同步设计平台相结合的设计流程中,采用SMIC55nm工艺库,在32.768kH...
关键词：RTC 低功耗 异步自时钟电路 
一种基于相对延时比模型的全数字时钟电路产生器
《微电子学与计算机》2017年第6期49-53,共5页孙雅芃 谢正章 赵慧冬 乔树山 黑勇 张福海 
国家自然科学基金项目(61306025;61474135)
设计了一种应用于低功耗领域的基于相对延时比模型的全数字时钟生成器,解决了环形振荡器产生振荡周期受到工艺偏差、环境温度偏移和供电电压抖动等因素影响的问题.该时钟生成器由相对延时比生成器、映射译码单元和数字控制振荡器组成.一...
关键词：低功耗 全数字 时钟生成器 相对延时比模型 
一种高性能低功耗SEU免疫锁存器
《微电子学》2016年第4期524-529,共6页黄正峰 钱栋良 彭小飞 欧阳一鸣 易茂祥 方祥圣 
国家自然科学基金资助项目(61574052;61274036;61371025;61474036);安徽省自然科学基金资助项目(1608085MF149)
为了缓解瞬态故障引发的软错误,提出一种对单粒子翻转完全免疫的加固锁存器。该锁存器使用4个输入分离的反相器构成双模互锁结构,使用具有过滤瞬态故障能力的C单元作为输出级,采用快速路径设计和钟控设计以提升速度和降低功耗。Hspice...
关键词：加固锁存器 瞬态故障 单粒子翻转 软错误 门控时钟电路 
一种具有延迟校准功能的可编程多相位时钟电路被引量：1
《西安电子科技大学学报》2014年第6期57-64,共8页刘术彬 朱樟明 赵扬 恩云飞 刘帘曦 杨银堂 
国家自然科学基金资助项目(61234002;61322405;61306044;61376033);国家863计划资助项目(2012AA012302;2013AA014103);教育部博士点基金资助项目(20120203110017);电子元器件可靠性物理及其应用技术重点实验室开放基金资助项目(ZHD201101)
基于延迟锁相环原理,提出了一种新型的具有延迟校准功能的可编程多相位时钟电路,能为工作在80MHz的电荷耦合器件信号处理器提供精度高达390ps的时序信号.将主时钟的单周期等分为32份,通过可编程相位组合电路,产生相位及占空比可调的信号...
关键词：电荷耦合器件 延迟锁相环 延迟校准环路 可编程相位组合器 
一种应用于非接触智能卡锁相环连续时钟电路
《中国集成电路》2014年第5期35-39,共5页徐洋 万培元 林平分 
本文针对13.56MHz非接触智能卡芯片(符合ISO/IEC14443 type A协议标准)特殊应用,实现一种基于锁相环结构的连续时钟电路。电路在载波存在或丢失情况下,均能提供稳定准确的时钟频率,连续时钟电路输出13.56MHz时钟,功耗60μA,面积为165X15...
关键词：智能卡 锁相环 连续时钟 
PCB板中时钟电路的EMC问题探究被引量：1
《电子制作》2013年第6X期12-12,3,共2页陈宁 蒋晓燕 
为研究PCB集成电路板中时钟电路引起的电磁兼容问题,对时钟电路的电磁兼容问题设计时几种主要影响因素进行了分析研究。为以后的PCB板时钟电路的设计提供了思路。
关键词：时钟电路 阻抗控制 传输延迟 
一种低功耗高电源抑制的时钟电路
《长春工业大学学报》2013年第3期286-289,共4页杨博 刘庆飞 韩律 胡波 
科技部科技企业创新项目(09C26223203862)
设计了一种具有高电源抑制功能的时钟电路,电路既降低了输出时钟信号对电源扰动的敏感度,又同时实现了稳定基准电压和时钟信号双输出。
关键词：时钟电路 电源扰动 基准电压 
一种降低电源峰值电流的电荷泵电路
《电路与系统学报》2012年第6期1-5,共5页王雪强 潘立阳 伍冬 周润德 
973国家重点基础研究项目(编号为2011CBA00602);国家自然科学基金(编号为60876076);国家重点科技专项支持(2010ZX01032-1-1-4;2009ZX02023-5-3)
为了降低电荷泵电路启动过程中的峰值电流,本文提出了一种具有低峰值电流的电荷泵电路。该电路中采用N-相位时钟电路,产生N个相位不交叠的时钟信号,使得电荷泵启动过程中时钟电路仅对一个电容进行充放电,从而有效减少了电源峰值电流。Hs...
关键词：电荷泵电路 峰值电流 N-相位时钟电路 
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