高速时钟电路

作品数：13被引量：29H指数：2
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基于SRIO传输的高速时钟电路的优化设计
《计算机测量与控制》2016年第10期213-214,218,共3页杜金艳 叶旭鸣 
针对某信号处理系统在试验、调试的过程中,偶尔出现SRIO链路异常断开的现象进行了深入的分析,发现在SRIO链路工作过程中,链路的高速时钟信号受到了热噪声的影响,引起时钟的过零点采样错误,导致SRIO链路断开;因此,对高速时钟信号的参数...
关键词：过零点 热噪声 过渡斜率 可靠 
高速并行处理模式下同步时序研究被引量：2
《液压与气动》2015年第11期131-134,共4页查环 
总结了高速时钟电路时序分析及计算方法,并且对SDRAM在源同步工作方式下的总线时序计算做出了全面的介绍。通过对实际电路设计的分析得出了具有参考价值的结论,并对高速电路的PCB布局给出了分析。
关键词：高速时钟电路 源同步工作方式 裕量 SDRAM 
一种多路可编程高速时钟电路的设计被引量：1
《电子产品世界》2012年第7期43-45,共3页童林 
本文采用博亚20MHz高稳定度晶体振荡器、集成VCO的低相位噪声锁相环时钟芯片LMX2531、高精度时钟扇出器HMC987LP5E和多阶低通滤波器,实现具有低相噪特性的4路并行输出、频率最高为2.5GHz的高速时钟电路的设计。文中给出了多路可编程高...
关键词：高速时钟 EV10AQ190 LMX2531 低相噪 
可编程高速时钟电路设计与实现
《黑龙江科学》2010年第6期25-27,共3页肖景仲 林秋华 
针对高速信号处理领域中,系统所需的高性能稳定的高速时钟电路的设计进行研究。采用了一种具有可编程配置的高速时钟芯片ADF4360-7,并利用CPLD完成对芯片的配置,其时钟输出频率范围在350MHz～1.8GHz,且功率输出可配置。经过系统实际测试...
关键词：可编程 高速时钟 相位噪声 
利用扩频技术减少高速时钟电路的电磁干扰被引量：2
《电子质量》2008年第6期94-96,共3页韩晓轩 
数字电子设备的运行速度越来越快,其时钟频率就越来越高,时钟电路产生的辐射干扰就越为严重。本文介绍了一种对抑制时钟电路辐射干扰较为有效的方法-时钟扩频技术。
关键词：电磁兼容 辐射干扰 高速时钟电路 时钟扩频技术 
高速时钟电路的可靠性设计
《电子测试》2007年第11期60-62,44,共4页袁海鹰 洪明禄 黄会雄 
本文介绍单片机及数字电路系统中高速时钟电路可靠性设计思路与方法。提出了高速时钟源的电源滤波电路的可靠性设计方法、提出了如何解决高速时钟走线的串扰问题手段、高速时钟延时调整及处理方法、高速时钟信号布线方法。
关键词：高速时钟 串扰与辐射 可靠性设计 
基于GPS接收机高速电路的信号完整性分析
《导航》2007年第1期25-28,共4页张琦 
本文介绍了高速电路信号完整性问题产生的机理，深入研究高速数字电路设计中的信号完整性问题；分析电路中破坏信号完整性的原因；结合一个实际的GPS接收机高速电路、阐述实现信号完整性的具体方案。
关键词：高速时钟电路 IBIS模型 信号完整性 
高速时钟电路的EMC设计被引量：2
《电子测试（新电子）》2006年第12期29-34,共6页王斌 
能产生射频范围内信号的设备都可能产生电磁干扰(EMI),在高速数字系统中,时钟电路是主要的电磁干扰源,时钟电路的EMC(电磁兼容性)设计好坏直接关系到系统辐射情况和系统的性能。本文讨论了时钟电路中电磁干扰的产生机理和危害,以及降低...
关键词：高速时钟电路 EMC设计 高速数字系统 电磁干扰源 电磁兼容性 信号 射频 
基于高速时钟电路终端的信号完整性分析被引量：2
《电讯技术》2005年第3期185-188,共4页陈倩 
本文分析了高速时钟电路的终端在确保信号完整性方面的重要作用,介绍了几种常用的终端方法,并用软件对采用上述终端方法的具体电路进行了仿真,最后从工程实现的角度选用了一种适宜的终端方法,得到了实测结果。
关键词：高速时钟电路 终端 信号完整性 分析 
基于PCB仿真的高速时钟电路设计研究被引量：13
《计算机仿真》2004年第9期175-178,共4页张艳丽 安琪 王砚方 
随着电子线路设计复杂程度的增加 ,以及人们对于电路性能要求的不断提高 ,对于高速电路设计的仿真显示出越来越重要的地位。该文主要介绍了基于信号噪声分析软件 (SigNoise)对于印刷电路板 (PCB)的仿真 ,并对高速时钟电路设计中的传输...
关键词：PCB仿真 高速时钟电路设计 信号噪声分析软件 SigNoise 印刷电路板 传输线 阻抗匹配 
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