国家高技术研究发展计划(2002AA1Z1130)

作品数：8被引量：3H指数：1
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相关作者：陈杰沈筱彦刘洋王明明曾晓文更多>>
相关机构：中国科学院微电子研究所中国科学技术大学更多>>
相关期刊：《电子器件》《电子科技大学学报》《微电子学与计算机》《计算机应用研究》更多>>
相关主题：DSP处理器VERILOG硬件描述语言统一建模语言同态映射DSP更多>>
相关领域：电子电信自动化与计算机技术更多>>
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低功耗、低复杂度TURBO码实现研究
《电子科技大学学报》2006年第4期481-483,共3页姜小波 陈杰 仇玉林 
国家863计划基金资助项目(2002AA1Z1130)
提出了一种改进的TURBO码算法,该算法改进了传统算法的路径度量的运算和可靠度的运算,可以显著地减少TURBO解码器使用的硬件资源,存储器的使用是传统算法的一半。根据改进的算法,该文还提出了一种新的加比选运算单元,综合结果和功耗分...
关键词：TURBO码 软输出维特比算法 低功耗 加比选 
基于同态映射的从UML导出可综合Verilog算法
《计算机科学》2006年第4期247-249,共3页沈筱彦 陈杰 
863重点项目<32位高性能嵌入式数字信号处理器(DSP)芯片设计与实现>(项目号:2002AA1Z1130)
UML 建模因其可显著提高开发效率和代码质量已经成为软件开发领域的一大热点,而硬件设计的日益复杂性也要求我们在更高层次抽象上分析和验证系统行为,故更精细的系统级建模方法变得日趋重要。本文构建了UML 元模型与可综合 Verilog 间...
关键词：统一建模语言(UML) VERILOG硬件描述语言 同态映射 
UML到Verilog同态映射在SOC系统级建模上的应用被引量：1
《微电子学与计算机》2006年第2期1-5,共5页沈筱彦 陈杰 王明明 
国家863计划项目(2002AA1Z1130)
SOC设计变得日益复杂要求我们在更高层次抽象上分析和验证系统行为。更精细的系统级建模方法变得日趋重要。文章主要目标是阐述怎样使用统一建模语言UML来构建一个复杂SOC设计框架及抽象其各个模块间行为的交互,建立了一个UML到Verilog...
关键词：统一建模语言 VERILOG硬件描述语言 片上系统(SOC) 建模 同态映射 
新型的DSP处理器高速低功耗多功能乘累加单元(英文)
《电子器件》2006年第1期48-52,57,共6页高健 陈杰 
863项目资助(2002AA1Z1130)
介绍了一种采用新型结构的应用于DSP处理器的多功能高速低功耗乘累加单元(MAC)。该设计采用了异步互锁流水线技术,极大的降低了功耗。在整个设计的关键路径即部分积产生和生成部分采用的互补部分积字校正(CPPWC)和三维压缩法(TDM)很好...
关键词：乘累加单元 异步流水线 部分积字校正 三维压缩法 
JPEG解码器的软硬件协同设计被引量：2
《微电子学与计算机》2005年第3期23-27,共5页刘洋 陈杰 
国家863项目"32位高性能嵌入式数字信号处理器(DSP)芯片设计与实现"(2002AA1Z1130)
JPEG压缩标准已被广泛的应用于数码相机、图像网络传输等众多领域,实时处理对JPEG解码器提出了更高的要求。本文设计出适合JPEG快速解码的嵌入式可重构32位DSP(DigitalSignalProcessing),并基于此款DSP结构对JPEG解码器进行了系统和局...
关键词：DSP处理器 JPEG 图像解码 
一种通用DSP单端口指令Cache设计
《微电子学与计算机》2004年第11期141-145,共5页曾晓文 陈杰 胡访宇 
国家863重点项目资助(2002AA1Z1130)
在一款采用改进HARVARD总线结构的通用DSP中,通过设置一个小型指令CACHE来缓解流水线上的资源冲突。它采用两路组相连结构,仅在流水线上发生资源冲突时才会被访问。出于减小CACHE的面积和功耗考虑,该CACHE采用了单地址端口的设计,也就...
关键词：DSP流水线 CACHE冲突 策略 
高性能16位定点DSP的Datapath设计及FPGA验证
《微电子学与计算机》2004年第5期142-145,149,共5页张馨 陈杰 李莺 黎宝峰 
国家863重点项目(2002AA1Z1130)
随着数字化产品的不断普及,以高速、实时为特点的数字信号处理器(DigitalSignalProcessors,DSPs)越来越多地应用到国防和消费等各个领域。文章介绍了一款嵌入式高性能16位定点DSPs的Datapath(数据通路)设计,以Datapath中各功能单元为线...
关键词：DSP 计算单元 Datapath FPGA 
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