时钟抖动

作品数：168被引量：276H指数：9
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基于碳基500nm工艺的双采样真随机数发生器
《半导体技术》2024年第8期732-741,757,共11页蔡铭嫣 张九龄 陈智峰 廖文丽 陈译 陈铖颖 
福建省自然科学基金(2023H0052);厦门市重大科技计划项目(3502Z20221022)。
碳纳米管场效应晶体管(CNTFET)因其极小的尺寸、超高的载流子迁移率、准一维结构的弹道输运等特性,顺应了未来集成电路高集成化和微型化的发展趋势。基于课题组构建的500 nm碳基工艺设计包,设计了一款真随机数发生器(TRNG)。碳基真随机...
关键词：碳纳米管场效应晶体管(CNTFET) 紧凑模型 真随机数发生器(TRNG) 振荡器 时钟抖动 
视频处理器中电荷泵锁相环设计
《半导体技术》2012年第10期750-754,共5页邓文娟 邹继军 刘树博 王嵩 陈坚 陈培根 
国家自然科学基金资助项目(61067001)
为产生一个与视频信号中的行同步信号严格同步的时钟信号,设计了一种数模混合结构的电荷泵锁相环(PLL)电路。通过对锁相环电路中鉴频鉴相器、电荷泵电路、振荡器电路设计适当改进,实现了性能稳定的时钟信号。采用中芯国际公司的0.35μm ...
关键词：视频解码芯片 同步信号 电荷泵锁相环 互补型金属氧化物半导体 时钟抖动 
SDH/SONET支路时钟抖动衰减数字锁相环设计被引量：1
《半导体技术》2009年第1期27-30,共4页叶波 罗敏 王紫石 
提出了一种新的光纤通信网络中SDH/SONET支路时钟抖动衰减设计方法。采用全数字锁相环技术和可编程的方法,根据不同类型的PDH信号,配置相应的增益和衰减因子,使得时钟的抖动衰减收敛速度可调节,能快速的达到国际电信联盟ITU-T标准规定...
关键词：数字抖动 衰减 数字锁相环 
用于高速ADC的低抖动时钟稳定电路被引量：2
《半导体技术》2008年第12期1143-1147,共5页张红 周述涛 张奉江 张正璠 
介绍了一种用于高速ADC的低抖动时钟稳定电路。这个电路由延迟锁相环(DLL)来实现。这个DLL有两个功能:一是通过把一个时钟沿固定精确延迟半个周期,再与另一个沿组成一个新的时钟来调节时钟占空比到50%左右;二是调节时钟抖动。该电路采用...
关键词：高速A/D转换器 延迟锁相环 占空比稳定 时钟抖动 
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