动态功耗

作品数:175被引量:261H指数:8
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相关作者:戚隆宁黄少珉胡晨张波郭锐锋更多>>
相关机构:中国科学院东南大学西安电子科技大学电子科技大学更多>>
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基于MAC单元的低功耗低延时FIR滤波器的设计与分析被引量:1
《现代电子技术》2016年第16期155-158,共4页李琼 杜爱民 曹馨 赵琳 李翠红 
中国国家基础研究发展计划(2014CB845903;2012CB825604);国家R&D关键科学仪器项目(ZDYZ2012-1-01)
乘法器在数字信号处理系统中承担了很重要的作用,而乘法器消耗相当大的功耗,因此有必要进行乘法器的低功耗研究。介绍一种基于乘法累加(MAC)单元的FIR滤波器的设计,其中乘法器利用基4华莱士树乘法器,加法器利用超前进位加法器,在优化整...
关键词:有限冲激响应滤波器 MAC单元 动态功耗 延时 
IGBT功耗计算及其优化的研究被引量:2
《现代电子技术》2014年第17期122-124,共3页王瑞 
绝缘栅双极晶体管(IGBT)因具备双极和功率MOSFET两种特性的独特优势,在超高电压电力传输、新能源的开发利用等方面获得广泛应用。但目前国内IGBT发展滞后,且其功耗性能及优化一直是国际上功率器件领域内研究的热点和难点。在先前研究的I...
关键词:IGBT 静态功耗 动态功耗 MOSEET PSPICE 
FPGA设计中功耗的分析与仿真被引量:3
《现代电子技术》2014年第5期131-133,共3页吴维起 刘安芝 高广珠 
FPGA的应用越来越广泛,随着制造工艺水平的不断提升,越来越高的器件密度以及性能使得功耗因数在FPGA设计中越来越重要。器件中元件模块的种类和数量对FPGA设计中功耗的动态范围影响较大,对FPGA的电源功耗进行了分析,并介绍了如何利用Alt...
关键词:静态功耗 动态功耗 触发率 
基于FPGA的24×24位低功耗乘法器的设计被引量:1
《现代电子技术》2010年第22期15-18,共4页邢金朋 李哲英 
通过对现有编码算法的改进,提出一种新的编码算法,它降低功耗的方法是通过减少部分积的数量来实现的。因为乘法器的运算主要是部分积的相加,因此,减少部分积的数量可以降低乘法器中加法器的数量,从而实现功耗的减低。在部分积的累加过程...
关键词:乘法器 动态功耗 FPGA ASIC 
一种低功耗异步FIFO存储器的设计
《现代电子技术》2008年第18期1-3,7,共4页张海勇 叶显阳 皮代军 秦水介 
贵州省自然科学基金((2002)No.3014);贵州省自然科学基金((2003)No.3005);2003年度教育部"优秀青年教师资助计划"(教人司[2003]355号);贵州省国际科技合作项目(黔科合国字(2004)11004号);贵州省优秀青年科技人才培养计划基金(黔科合人字No.2013);贵州大学校研究生创新基金:(2007007)
针对传统异步FIFO功耗较高的缺点,设计一种低功耗异步FIFO存储器。通过采用对异步读写指针的前两个状态位直接比较的方法,减少格雷码向二进制转换的电路,并增加门控时钟电路,从而大大降低了存储器的动态功耗。通过软件QuartusⅡ7.2对其...
关键词:异步FIFO 格雷码 门控时钟 动态功耗 
PowerPC 603e低功耗技术的开发被引量:1
《现代电子技术》2004年第5期1-4,共4页张春朋 李跃进 
Power PC6 0 3e是一款高性能、低成本、低功耗的 32位超标量 RISC微处理器。本文简要介绍了 Power PC6 0 3e结构 ,详细介绍了 Power PC6 0 3e动态功耗管理、静态功耗管理设计技术及一些低功耗技术 ,最后给出了 Power
关键词:P0werPC 微处理器 动态功耗管理 静态功耗管理 
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