VERILOGHDL

作品数：183被引量：395H指数：9
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前导数字并行纠错单元的设计与仿真
《微电子学与计算机》2017年第5期67-72,共6页魏思捷 富坤 袁玉倩 耿跃华 
国家自然科学基金(51577131)
对前导数字预测算法的误差修正逻辑进行分析改进和设计实现,重点对该误差修正纠错模块的逻辑设计进行了分析证明,依据设计的逻辑表达式对其电路进行了设计.同时采用硬件描述语言VerilogHDL编程,结果使用QuartusⅡ进行仿真验证.使用性能...
关键词：前导数字预测 误差修正逻辑 VERILOGHDL QuartusⅡ 
基于FPGA的三操作数前导1预测算法的设计与性能分析被引量：2
《微电子学与计算机》2015年第5期41-45,50,共6页罗淑贞 富坤 高艳 孙豪赛 耿跃华 
国家自然科学基金(31100711);河北省高等学校科学技术研究青年基金(20111122);河北省交通运输厅科学技术项目计划(Y2011087)
针对传统算法的局限,在FPGA平台上设计了直接处理三操作数的前导1预测算法的完整实现方案,可以有效缩短关键路径延时和功耗.重点设计出了三操作数的编码树结构,并依据预编码规则,在FPGA硬件验证平台上对系统结构合理模块化,且采用硬件...
关键词：前导1预测算法 三操作数 FPGA VERILOGHDL 
基于HDL的PAL制数字视频图像采集控制器设计被引量：8
《微电子学与计算机》2007年第12期191-194,共4页钱敏 李富华 黄秋萍 李文石 刘蓓 
苏州市科技招标项目
介绍了PAL制电视信号的组成和数字视频图像采集的过程;用Verilog-HDL设计了PAL制数字视频图像采集的控制电路;该控制器为DSP进行实时数字图像处理准备好RGB数据,其中包括数据采集控制电路、存储器接口、总线切换电路和DSP接口等电路;在M...
关键词：PAk视频信号采集 控制器 VERILOGHDL 
基于VerilogHDL的IP核参数化设计被引量：3
《微电子学与计算机》2005年第12期85-88,共4页徐晨 袁红林 
上海市科委SDC专项计划资助(037062026)
指出了IP核参数化设计的重要性,分析了IP核的参数类型及相互关系。在分析基于VerilogHDL的IP核参数化设计方法及所面临困难的基础上,提出了一种附加的编译预处理方法并设计了相应的工具软件ECP。IP核由VerilogHDL和ECP扩展的语句混合编...
关键词：IP核 参数化设计 VERILOGHDL 编译预处理 中断控制IP 
基于PDIUSBD12的高速USB数据交换设备被引量：2
《微电子学与计算机》2004年第6期57-59,共3页王滔 季晓勇 
文章详细解释了如何使用USB接口芯片PDIUSBD12的DMA功能,大幅提升数据传输速率;同时介绍了利用VerilogHDL在CPLD上实现DMA控制器的方法。
关键词：USB PDIUSBD12 DMA VERILOGHDL 
采用周期精确的方法实现一个I^2C接口被引量：3
《微电子学与计算机》2002年第10期35-37,40,共4页方承志 李元 谈宜育 
文章探讨VerilogHDL中采用周期精确方式描述数字系统的基本原则,并以此实现了一个EEPROM的I2C接口设计,该设计稍作改动后,可以应用于其它器件。
关键词：I^2C接口 周期精确 VERILOGHDL EEPROM 
微处理器中中断电路的高层设计被引量：4
《微电子学与计算机》2001年第4期1-4,共4页胡永华 高明伦 王锐 
国家自然科学基金资助( 6987010);高等学校博士学科点专项科研基金( 98035901);安徽省自然科学基金( 98324021)
文章介绍了一种采用中断执行周期复用、寄存器模型设计中断标识信号的中断电路实现方法，并给出了关键控制信号的 Verilog HDL程序实现。该实现方法可以作为一个功能部件直接在微处理器设计中加以运用；中断标识信号的优先级与触发时刻...
关键词：微处理器 中断电路 VERILOGHDL 中断处理 设计 
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